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參數(shù)資料
| 型號： | PSD702S5 |
| 英文描述： | Field Programmable Microcontroller Peripherals with Supervisory Functions(可編程邏輯，4K位SRAM,27個(gè)可編程I/O,通用PLD有66個(gè)輸入) |
| 中文描述： | 現(xiàn)場可編程微控制器外圍設(shè)備具有監(jiān)督職能（可編程邏輯，4K的位的SRAM，27余個(gè)可編程輸入/輸出，通用PLD的有66個(gè)輸入） |
| 文件頁數(shù)： | 50/104頁 |
| 文件大?。?/td> | 515K |
| 代理商： | PSD702S5 |
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PSD7XX Family
13-50
I/O Ports
(cont.)
Port Data Registers
(cont.)
Register I/O Address Offset
The base address of the Registers is defined in the CSIOP equation that occupies
256 bytes of address space and is defined by the user in PSDsoft. The lower address byte
A[7:0], or address offset, selects the register. Table 28 shows the address offset for all
MCUs except those Motorola microcontrollers with a 16-bit data bus. Table 28A shows the
address offset for Motorola MCUs in 16-bit mode.
For example, when the CSIOP is defined to occupy the address range of 1000h to 10FFh in
PSDabel, the address of the Port A Control Register is then 1002h.
Register Name
Port A
Port B
Port C
Port D
Data In
00
01
10
11
Control
02
03
Data Out
04
05
12
13
Direction
06
07
14
15
Drive
08
09
16
17
Input Micro
Cell
0A
0B
18
Enable Out
0C
0D
1A
Output Micro
Cell
20
20
21
Table 28. I/O Register Address Offset (relative to CSIOP)
Register Name
Port A
Port B
Port C
Port D
Data In
01
00
11
10
Control
03
02
Data Out
05
04
13
12
Direction
07
06
15
14
Drive
09
08
17
16
Input Micro
Cell
0B
0A
19
Enable Out
0D
0C
1B
Output Micro
Cell
21
21
20
Table 28A. Register Address Offset for 16-Bit Motorola Microcontrollers
in 16-Bit Mode (relative to CSIOP)
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PDF描述 |
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