參數(shù)資料
型號： PSD413A2F
英文描述： Field Programmable Microcontroller Peripherals with Flash Memory(可編程邏輯，16K位SRAM,35個可編程I/O,通用PLD有59個輸入)
中文描述： 現(xiàn)場可編程微控制器外圍設(shè)備與快閃記憶體（可編程邏輯，16K的位的SRAM，35余個可編程輸入/輸出，通用PLD的有59個輸入）
文件頁數(shù)： 68/98頁
文件大小： 365K
代理商： PSD413A2F
PSD413F Family
6-68
ADVANCE INFORMATION
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
V
CC
Supply Voltage
All Speeds
4.5
5
5.5
V
V
IH
High Level Input Voltage
4.5 V < V
CC
< 5.5 V
2
V
CC
+.5
V
V
IL
Low Level Input Voltage
4.5 V < V
CC
< 5.5 V
–0.5
0.8
V
V
IH1
Reset High Level Input Voltage
(Note 1)
.8 V
CC
V
CC
+.5
V
V
IL1
Reset Low Level Input Voltage
(Note 1)
–.5
.2 V
CC
–.1
V
V
HYS
Reset Pin Hysteresis
0.3
V
V
OL
Output Low Voltage (Note 4b)
I
OL
= 20 μA, V
CC
= 4.5 V
0.01
0.1
V
I
OL
= 8 mA, V
CC
= 4.5 V
0.15
0.45
V
V
OH
Output High Voltage (Note 4b)
I
OH
= –20 μA, V
CC
= 4.5 V
4.4
4.49
V
I
OH
= –2 mA, V
CC
= 4.5 V
2.4
3.9
V
V
LKO
Low V
CC
Lock-Out Voltage
3.2
3.7
V
V
SBY
SRAM Standby Voltage
2.7
V
CC
V
I
SBY
SRAM Standby Current
V
CC
= 0 V
0.5
1
μA
I
IDLE
Idle Current (V
STBY
Pin)
V
CC
> V
SBY
–0.1
0.1
μA
V
DF
SRAM Data Retention Voltage
Only on V
STBY
2
V
I
SB
Standby Supply
Current
Power Down Mode
CSI >V
CC
–.3 V (Note 2)
125
150
μA
Sleep Mode
CSI >V
CC
–.3 V (Note 3)
110
120
μA
I
LI
Input Leakage Current
V
SS
< V
IN
< V
CC
–1
±.1
1
μA
I
LO
Output Leakage Current
0.45 < V
IN
< V
CC
ZPLD_TURBO = OFF,
f = 0 MHz (Note 4)
–10
±5
10
μA
ZPLD Only
ZPLD_TURBO = ON,
f = 0 MHz
I
CC
(DC)
(Note 4a)
Operating
Supply Current
400
700
μA/PT
During Flash Read,
f = 0 MHz
10
18
mA
Flash DC Adder
During Flash Erase/Write,
f = 0 MHz
25
50
mA
ZPLD AC Base
(Note 4)
Boot EPROM
AC Adder
CMiser = ON
(8-Bit Bus Mode)
0.8
2
mA/MHz
All Other Cases
1.8
4
mA/MHz
I
CC
(AC)
(Note 4a)
Flash AC Adder
2
mA/MHz
CMiser = ON and
8-Bit Bus Mode
1.4
2.7
mA/MHz
SRAM AC Adder
CMiser = ON and
16-Bit Bus Mode
2
4
mA/MHz
CMiser = OFF
3.8
7.5
mA/MHz
DC Characteristics
(5 V ± 10% Versions)
NOTES:
1.
2.
3.
4.
4a. I
= 0 mA.
4b. Except PA0 – PA3, PB0.These pins are used for internal operations and should not be used as outputs.
Reset input has hysteresis. V
is valid at or below .2V
CC
–.1. V
IH1
is valid at or above .8V
CC
.
CSI deselected or internal PD is active.
Sleep mode bit is set and internal PD is active.
See ZPLD ICC/Frequency Power Consumption graph for details.
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PDF描述
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PSD4235G2-90U 功能描述:CPLD - 復雜可編程邏輯器件 5.0V 4M 90ns RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
PSD4235G2-90UI 功能描述:CPLD - 復雜可編程邏輯器件 5.0V 4M 90ns RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
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