參數(shù)資料
型號: PSB3186
英文描述: The IRAC1150-D2 Control Board is designed to demonstrate the performance of the IR1150S control IC in a continuous conduction mode boost converter for PFC.; A IRAC1150-D2 with Standard Packaging
中文描述: 3.3伏ISDN用戶終端訪問控制器eXtended擴展
文件頁數(shù): 149/200頁
文件大小: 2959K
代理商: PSB3186
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ISAC-SX TE
PSB 3186
Detailed Register Description
Data Sheet
149
2003-01-30
LD ... Level Detection
Any receive signal has been detected on the line. This bit is set to “1” (i.e. an interrupt is
generated if not masked) as long as any receiver signal is detected on the line.
RIC ... Receiver INFO Change
RIC is activated if one of the TR_STA bits RINF or ICV has changed. This bit is reset by
reading the TR_STA register.
SQC ... S/Q-Channel Change
A change in the received S-channel has been detected. The new code can be read from
the SQRxx bits of registers SQRR1-3 within the duration of the next multiframe (5 ms).
This bit is reset by a read access to the corresponding SQRRx register.
SQW ... S/Q-Channel Writable
The S/Q channel data for the next multiframe is writable.
The register for the Q (S) bits to be transmitted (received) has to be written (read) within
the duration of the next multiframe (5 ms). This bit is reset by writing register SQXRx.
4.2.10
Value after reset: FF
H
MASKTR - Mask Transceiver Interrupt
The transceiver interrupts LD, RIC, SQC and SQW are enabled (0) or disabled (1).
4.2.11
Value after reset: 00
H
ACFG2 - Auxiliary Configuration Register
Note: Although no other Auxiliary Configuration Registers are supported by ISAC-SX
TE, the name ACFG2 for this register was chosen intentionally in compliance with
ISAC-SX PEB3086.
7
0
MASKTR
1
1
1
1
LD
RIC
SQC
SQW
RD/WR (39)
7
0
ACFG2
0
0
0
0
ACL
LED
0
0
RD/WR (3D)
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PDF描述
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