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參數(shù)資料
| 型號： | PM8611-BIAP |
| 廠商： | PMC-Sierra, Inc. |
| 英文描述： | SBSLITE⑩ Telecom Standard Product Data Sheet Preliminary |
| 中文描述： | SBSLITE⑩電信標準產(chǎn)品數(shù)據(jù)的初步 |
| 文件頁數(shù)： | 273/292頁 |
| 文件大?。?/td> | 1585K |
| 代理商： | PM8611-BIAP |
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SBSLITE Telecom Standard Product Data Sheet
Preliminary
Proprietary and Confidential to PMC-Sierra, Inc., and for its Customers’ Internal Use
Document ID: PMC-2010883, Issue 2
272
14 Functional Timing
14.1
Incoming SBI336 Bus Functional Timing
Figure 31 shows the functional timing for the incoming 77.76 MHz SBI336 bus configured for
connection to a physical layer device. When configured for the SBI336 bus, timing is provided
by a 77.76 MHz SREFCLK which is also connected to SYSCLK. When connecting to a physical
layer device, the justification request signal, JUST_REQ, is used by the physical layer device to
control link timing from a slave link layer device and is an input to the SBSLITE.
Figure 31 shows a number of capabilities of the SBI bus. IC1FP is a 2 KHz pulse that indicates
the SBI336 frame alignment from which all control signals and data are synchronized. The
payload signal indicates valid tributary data as well as positive and negative tributary timing
adjustments. In Figure 31 the first occurrence of IPL high shows a negative timing adjustment
where valid data is carried in the V3 location. The last cycle with IPL low indicates a positive
timing adjustment in the tributary octet after V3 where there is no valid data. The IV5 signal
indicates that the current data octet is the V5 octet used for tributary framing alignment. The
JUST_REQ signal is only valid during the V3 octets and the tributary octets following the V3
octets. The first occurrence of JUST_REQ high during the V3 octet indicates to the slave link
layer device that it should speed next frame by performing a negative timing adjustment. The
second occurrence of JUST_REQ high during the tributary octet after the V3 octet indicates to
the slave link layer device that it should slow down by performing a positive timing adjustment
during the next frame. The last V3 in the diagram is meant to be the last V3 for all the tributaries.
The ICMP signal selects the active connection memory page in the memory switch. It is sampled
at the C1 byte position in every multiframe. ICMP is ignored at all other positions within the SBI
frame. The connection memory page is switched on the next SBI bus multiframe boundary after
ICMP is sampled. The SBI multiframe can be either 4 or 48 frames, depending on the value of
MF_48 in the SBSLITE Master Configuration Register.
Figure 31 Incoming SBI336 Functional Timing
C1
V3
V3
DS0#9 V3
DS0#4 V5
DS0#2DS0#7
valid
SREFCLK
IC1FP
IPL
IV5
IDATA[7:0]
IDP
JUST_REQ
ICMP
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM8620 | 20G Narrowband Switch Element |
| PM8620-BIAP | NSE-20G⑩ Standard Product Data Sheet Preliminary |
| PM8621 | NSE-8G⑩ Standard Product Data Sheet Preliminary |
| PM8621-BIAP | NSE-8G⑩ Standard Product Data Sheet Preliminary |
| PM9311 | Enhanced TT1TM Switch Fabric |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM862 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Analog IC |
| PM8620 | 制造商:PMC 制造商全稱:PMC 功能描述:NSE-20G⑩ Standard Product Data Sheet Preliminary |
| PM8620-BIAP | 制造商:PMC 制造商全稱:PMC 功能描述:NSE-20G⑩ Standard Product Data Sheet Preliminary |
| PM8621 | 制造商:PMC 制造商全稱:PMC 功能描述:NSE-8G⑩ Standard Product Data Sheet Preliminary |
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