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參數(shù)資料
| 型號(hào)： | PM7329-BI |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | ATM TRAFFIC MANAGER AND SWITCH |
| 中文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, PBGA352 |
| 封裝： | 35 X 35 MM, 1.45 MM HEIGHT, SBGA-352 |
| 文件頁數(shù)： | 90/232頁 |
| 文件大?。?/td> | 1585K |
| 代理商： | PM7329-BI |
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PM7329 S/UNI-APEX-1K800
DATASHEET
PMC-2010141
ISSUE 2
ATM TRAFFIC MANAGER AND SWITCH
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA, INC., AND FOR ITS CUSTOMERS’ INTERNAL USE
76
It is possible to mix VCs that have FCQ and WFQ scheduling within the same
class, and ClassPacket enabled. Non FCQ VCs and non-user cells (as defined
in Table 8) are treated as single cell packets.
All counters, control and limit fields for the class scheduler are located in the
class scheduler context memory. As stated earlier, memory is only allocated for
classes one, two, and three. Class zero does not require any class scheduler
context information.
10.9.3.2
Partial Packet Scheduling
A per-Port parameter, ClassFragEn, is provided to support packet fragmentation.
In this fragmentation mode, classes are selected on a strict priority basis. Once
a class is selected, the packet at the head of the class queue is transmitted up to
a programmable length or until the EOM is encountered, whichever comes first.
Non FCQ VCs and non-user cells (as defined in Table 8) are treated as single
cell packets. When the length/EOM is reached, the classes are evaluated once
again in a strict priority. The transmission of the original packet will resume once
the original class regains transmission rights. Note that by virtue of the strict
priority scheduling, Class0 will always have its packets transmitted in their
entirety.
10.9.4 Congestion Control
The congestion control decides whether to permit a cell to enter the queue
structure. The objective is to provide a minimum reserved buffer allocation to all
active VCs and to fairly allocate shared buffer resources to eligible VCs. The
algorithm is applied to both frame and non-frame traffic. The objectives of the
algorithm are as follows:
provide guaranteed resources to all active VCs
share available buffer resources to eligible VCs with excess buffering
requirements
restrict resource allocation on a per-VC, per-Class, per-Port, and per-
Direction basis to those levels that have exceeded their allotment of
resources.
avoid global synchronization
Provide interrupts and ID of the last maximum threshold discard invoked.
These objectives are achieved by having several thresholds and hierarchical
count values, at the per-Device, per-Direction, per-Port, per-Class, and per-VC
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM7329 | ATM TRAFFIC MANAGER AND SWITCH |
| PM7339 | Quad Cell Delineation Block Device |
| PM7340 | S/UNI INVERSE MULTIPLEXING FOR ATM, 8 LINKS |
| PM7340-PI | SCREW,WING |
| PM7341 | S/UNI INVERSE MULTIPLEXING FOR ATM, 84 LINKS |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM733 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Analog IC |
| PM7339 | 制造商:PMC 制造商全稱:PMC 功能描述:SATURN USER NETWORK INTERFACE CELL DELINEATION BLOCK |
| PM734 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Analog IC |
| PM7340 | 制造商:PMC 制造商全稱:PMC 功能描述:S/UNI INVERSE MULTIPLEXING FOR ATM, 8 LINKS |
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