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參數(shù)資料
| 型號： | PM7323-SI |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | ROUTING CONTROL, MONITORING, & POLICING 200 MBPS |
| 中文描述： | ATM SWITCHING CIRCUIT, PQFP240 |
| 封裝： | 32 X 32 MM, 3.40 MM HEIGHT, 0.50 MM PITCH, HEAT SINK, PLASTIC, QFP-240 |
| 文件頁數(shù)： | 24/219頁 |
| 文件大?。?/td> | 695K |
| 代理商： | PM7323-SI |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁當(dāng)前第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁
STANDARD PRODUCT
PM7323 RCMP-200
DATASHEET
PMC-960543
ISSUE 2
ROUTING CONTROL, MONITORING, & POLICING
200 MBPS
Proprietary and Confidential to PMC-Sierra, Inc.
and for its Customer’s Internal Use.
13
8
PIN DESCRIPTION (TOTAL 240)
Table 1
- Output Cell Interface Signals (24)
Pin Name
Type
Pin
No.
Feature
OFCLK
Input
126
The output FIFO clock (OFCLK) is used to read
words from the Output Cell Interface. OFCLK
must cycle at a 25 MHz or lower instantaneous
rate, but at a high enough rate to avoid FIFO
overflow. OSOC, OCA, OPRTY and ODAT[7:0]
are updated on the rising edge of OFCLK.
ORDENB is sampled using the rising edge of
OFCLK.
ORDENB
Input
119
The active low read enable (ORDENB) signal is
used to indicate transfers from the Output Cell
Interface. When ORDENB is sampled low using
the rising edge of OFCLK, a word is read from
the internal synchronous FIFO and output on bus
ODAT[7:0]. When ORDENB is sampled high
using the rising edge of OFCLK, no read is
performed and outputs ODAT[7:0], OPRTY and
OSOC are tristated if the OTSEN input is high.
ORDENB must operate in conjunction with
OFCLK to access the FIFO at a high enough
instantaneous rate as to avoid FIFO overflows.
ODAT[0]
ODAT[1]
ODAT[2]
ODAT[3]
ODAT[4]
ODAT[5]
ODAT[6]
ODAT[7]
Tristate
114
113
112
107
106
105
104
103
The output cell data (ODAT[7:0]) bus carries the
ATM cell octets that are read from the output
FIFO. If the IBUS8 input is high, only ODAT[7:0]
carries cell octets. The ODAT[7:0] bus is updated
on the rising edge of OFCLK.
When the Output Cell Interface is configured for
tristate operation using the OTSEN input,
tristating of the ODAT[7:0] output bus is
controlled by the ORDENB input.
When OTSEN is low, the ODAT[7:0] bus is low
when no cell is being transferred.
相關(guān)PDF資料 |
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