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參數(shù)資料
| 型號(hào)： | PM7323-SI |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | ROUTING CONTROL, MONITORING, & POLICING 200 MBPS |
| 中文描述： | ATM SWITCHING CIRCUIT, PQFP240 |
| 封裝： | 32 X 32 MM, 3.40 MM HEIGHT, 0.50 MM PITCH, HEAT SINK, PLASTIC, QFP-240 |
| 文件頁(yè)數(shù)： | 160/219頁(yè) |
| 文件大?。?/td> | 695K |
| 代理商： | PM7323-SI |
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STANDARD PRODUCT
PM7323 RCMP-200
DATASHEET
PMC-960543
ISSUE 2
ROUTING CONTROL, MONITORING, & POLICING
200 MBPS
Proprietary and Confidential to PMC-Sierra, Inc.
and for its Customer’s Internal Use.
149
unable to accept any cells, which is the same immediate symptom as a full
buffer.
OCALEVEL0:
The OCALEVEL0 bit determines what the OCA output indicates when it
transitions inactive. When OCALEVEL0 is set to logic 1, a deassertion of the
OCA[1] outputs indicate that the output FIFO is empty. When OCALEVEL0 is
set to logic 0, a deassertion of the OCA output indicates that the output FIFO
is near empty and contains only four words.
OPTYP:
The OPTYP bit selects even or odd parity for outputs OPRTY. When set to
logic 1, OPRTY is the even parity bit for outputs ODAT[7:0]. When set to logic
0, OPRTY is the odd parity bits for outputs ODAT[7:0].
CELLLEN[3:0]:
The CELLLEN[3:0] bits determine the number of words in the output cell.
The binary CELLLEN[3:0] value is the number of bytes appended to the basic
53 byte ATM cell. The maximum cell length is 63 bytes; therefore, a
CELLLEN[3:0] greater than 10 decimal results in 10 appended bytes.
CELLPOST[3:0]:
The CELLPOST[3:0] bits determine the number of words in the output cell
post-pend. The numerical difference between CELLLEN[3:0] and
CELLPOST[3:0] represents the number of words in the pre-pend. It is
inappropriate that CELLPOST[3:0] exceed CELLLEN[3:0].
The binary CELLPOST[3:0] value is the number of bytes post-pended to the
basic 53 byte ATM cell.
OCAINV:
The OCAINV bit selects the active polarity of the OCA signal. The default
configuration selects OCA to be active high, indicating that a cell is available
when high. When OCAINV is set to logic one, the OCA signal becomes
active low. If the state of the OCAINV bit has been changed, the output FIFO
must be reset via the FIFORST bit in order to properly initialize the OCA
output.
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