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參數(shù)資料
| 型號(hào)： | PIC27CR43 |
| 廠商： | Microchip Technology Inc. |
| 英文描述： | High-Performance 8-Bit CMOS EPROM/ROM Microcontroller(每個(gè)I/O口有20mA吸收,35mA驅(qū)動(dòng),4K位PROM，微控制器) |
| 中文描述： | 高性能的8位CMOS存儲(chǔ)器/ ROM的微控制器（每個(gè)的I / O口有20mA的吸收，35毫安驅(qū)動(dòng)，4K的位胎膜早破，微控制器） |
| 文件頁數(shù)： | 91/241頁 |
| 文件大?。?/td> | 1548K |
| 代理商： | PIC27CR43 |
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1996 Microchip Technology Inc.
DS30412B-page 91
PIC17C4X
13.2.2
USART ASYNCHRONOUS RECEIVER
The receiver block diagram is shown in Figure 13-4.
The data comes in the RA4/RX/DT pin and drives the
data recovery block. The data recovery block is actually
a high speed shifter operating at 16 times the baud rate,
whereas the main receive serial shifter operates at the
bit rate or at F
OSC
.
Once asynchronous mode is selected, reception is
enabled by setting bit CREN (RCSTA<4>).
The heart of the receiver is the receive (serial) shift reg-
ister (RSR). After sampling the stop bit, the received
data in the RSR is transferred to the RCREG (if it is
empty). If the transfer is complete, the interrupt bit
RCIF (PIR<0>) is set. The actual interrupt can be
enabled/disabled
by
setting/clearing
(PIE<0>) bit. RCIF is a read only bit which is cleared by
the hardware. It is cleared when RCREG has been read
and is empty. RCREG is a double buffered register; (i.e.
it is a two deep FIFO). It is possible for two bytes of data
to be received and transferred to the RCREG FIFO and
a third byte begin shifting to the RSR. On detection of
the stop bit of the third byte, if the RCREG is still full,
then the overrun error bit, OERR (RCSTA<1>) will be
set. The word in the RSR will be lost. RCREG can be
read twice to retrieve the two bytes in the FIFO. The
OERR bit has to be cleared in software which is done
by resetting the receive logic (CREN is set). If the
OERR bit is set, transfers from the RSR to RCREG are
inhibited, so it is essential to clear the OERR bit if it is
set. The framing error bit FERR (RCSTA<2>) is set if a
stop bit is not detected.
the
RCIE
Note:
The FERR and the 9th receive bit are buff-
ered the same way as the receive data.
Reading the RCREG register will allow the
RX9D and FERR bits to be loaded with val-
ues for the next received Received data;
therefore, it is essential for the user to read
the RCSTA register before reading
RCREG in order not to lose the old FERR
and RX9D information.
13.2.3
SAMPLING
The data on the RA4/RX/DT pin is sampled three times
by a majority detect circuit to determine if a high or a
low level is present at the RA4/RX/DT pin. The sam-
pling is done on the seventh, eighth and ninth falling
edges of a x16 clock (Figure 11-3).
The x16 clock is a free running clock, and the three
sample points occur at a frequency of every 16 falling
edges.
FIGURE 13-7: RX PIN SAMPLING SCHEME
RX
baud CLK
x16 CLK
Start bit
Bit0
Samples
1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 1 2 3
Baud CLK for all but start bit
(RA4/RX/DT pin)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PIC17C752 | 64/68 Pin 8 Bit High-Performance 8-Bit CMOS EPROM/ROM Microcontroller(驅(qū)動(dòng)/吸收電流高，4路捕捉，3路PWM) |
| PIC17C756 | 64/68 Pin 8 Bit High-Performance 8-Bit CMOS EPROM/ROM Microcontroller(驅(qū)動(dòng)/吸收電流高，4路捕捉，3路PWM的微控制器) |
| pic17c756a | 64/68-Pin 8-Bit OTP High-Performance Microcontroller(具ADC的8位CMOS微控制器) |
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| PIC17FR43 | High-Performance 8-Bit CMOS FlexROM Microcontroller(每個(gè)I/O口有25mA驅(qū)動(dòng)/吸收電流,并行從動(dòng)口,2路捕捉/PWM的微控制器) |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PIC-28041TM2 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Optoelectronic |
| PIC-28042TM2 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Optoelectronic |
| PIC-28043TM2 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Optoelectronic |
| PIC-28044TM2 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Optoelectronic |
| PIC-28045TM2 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Optoelectronic |
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