參數(shù)資料
型號： PIC18F85J11
廠商： Microchip Technology Inc.
英文描述： 64/80-Pin High-Performance Microcontrollers with nanoWatt Technology
中文描述： 64/80-Pin高性能的微控制器采用納瓦技術
文件頁數(shù)： 242/396頁
文件大小： 2957K
代理商： PIC18F85J11
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PIC18F85J11 FAMILY
DS39774C-page 240
Preliminary
2007 Microchip Technology Inc.
18.2
AUSART Baud Rate Generator
(BRG)
The BRG is a dedicated, 8-bit generator that supports
both the Asynchronous and Synchronous modes of the
AUSART.
The SPBRG2 register controls the period of a
free-running timer. In Asynchronous mode, bit BRGH
(TXSTA<2>) also controls the baud rate. In Synchro-
nous mode, BRGH is ignored. Table 18-1 shows the
formula for computation of the baud rate for different
AUSART modes, which only apply in Master mode
(internally generated clock).
Given the desired baud rate and F
OSC
, the nearest
integer value for the SPBRG2 register can be calcu-
lated using the formulas in Table 18-1. From this, the
error in baud rate can be determined. An example
calculation is shown in Example 18-1. Typical baud
rates and error values for the various Asynchronous
modes are shown in Table 18-2. It may be advanta-
geous to use the high baud rate (BRGH =
1
) to reduce
the baud rate error, or achieve a slow baud rate for a
fast oscillator frequency.
Writing a new value to the SPBRG2 register causes the
BRG timer to be reset (or cleared). This ensures the
BRG does not wait for a timer overflow before outputting
the new baud rate.
18.2.1
OPERATION IN POWER-MANAGED
MODES
The device clock is used to generate the desired baud
rate. When one of the power-managed modes is
entered, the new clock source may be operating at a
different frequency. This may require an adjustment to
the value in the SPBRG2 register.
18.2.2
SAMPLING
The data on the RX2 pin is sampled three times by a
majority detect circuit to determine if a high or low level
is present at the RX2 pin.
TABLE 18-1:
BAUD RATE FORMULAS
EXAMPLE 18-1:
For a device with F
OSC
of 16 MHz, desired baud rate of 9600, Asynchronous mode, BRGH =
0
:
Desired Baud Rate
= F
OSC
/(64 ([SPBRG2] + 1))
Solving for SPBRG2:
X
=
((F
OSC
/Desired Baud Rate)/64) – 1
=
((16000000/9600)/64) – 1
=
[25.042] = 25
Calculated Baud Rate =
16000000/(64 (25 + 1))
=
9615
Error
=
(Calculated Baud Rate – Desired Baud Rate)/Desired Baud Rate
=
(9615 – 9600)/9600 = 0.16%
CALCULATING BAUD RATE ERROR
TABLE 18-2:
REGISTERS ASSOCIATED WITH THE BAUD RATE GENERATOR
Configuration Bits
BRG/AUSART Mode
Baud Rate Formula
SYNC
BRGH
0
0
Asynchronous
Asynchronous
Synchronous
F
OSC
/[64 (n + 1)]
F
OSC
/[16 (n + 1)]
F
OSC
/[4 (n + 1)]
0
1
1
x
Legend:
x
= Don’t care, n = Value of SPBRG2 register
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Reset
Values on
Page
TXSTA2
RCSTA2
SPBRG2
Legend:
CSRC
SPEN
AUSART Baud Rate Generator Register
— = unimplemented locations read as ‘
0
’. Shaded cells are not used by the BRG.
TX9
RX9
TXEN
SREN
SYNC
CREN
—
BRGH
FERR
TRMT
OERR
TX9D
RX9D
55
55
55
ADDEN
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