參數(shù)資料
型號(hào)： PI7C7300ANA
廠商： Pericom Semiconductor Corp.
英文描述： 3-PORT PCI-to-PCI BRIDGE
中文描述： 3端口PCI至PCI橋
文件頁(yè)數(shù)： 102/109頁(yè)
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代理商： PI7C7300ANA
PI7C7300A
3-PORT PCI-TO-PCI BRIDGE
ADVANCE INFORMATION
Page 102 OF 109
09/25/03 Revision 1.09
17.3
3.3V AC SPECIFICATIONS
Figure 17-1 PCI SIGNAL TIMING MEASUREMENT CONDITIONS
Symbol
Tsu
Tsu(ptp)
Th
Tval
Tval(ptp)
Ton
Toff
1.
See Figure 17-1 PCI Signal Timing Measurement Conditions.
2.
All primary interface signals are synchronized to P_CLK. All secondary interface
signals are synchronized to either S1_CLKOUT or S2_CLKOUT.
Parameter
Input setup time to CLK – bused signals
1,2,3
Input setup time to CLK – point-to-point
1,2,3
Input signal hold time from CLK
1,2
CLK to signal valid delay – bused signals
1,2,3
CLK to signal valid delay – point-to-point
1,2,3
Float to active delay
1,2
Active to float delay
1,2
66 MHz
Min.
3
5
0
2
2
2
-
33 MHz
Units
Max.
-
-
-
6
6
-
14
Min.
7
10, 12
4
0
2
2
2
-
Max.
-
-
-
11
12
-
28
ns
3.
Point-to-point signals are P_REQ#, S1_REQ#[7:0], S2_REQ#[6:0], P_GNT#,
S1_GNT#[7:0], S2_GNT#[6:0], HSLED, HS_SW#, HS_EN, and ENUM#. Bused
signals are P_AD, P_BDE#, P_PAR, P_PERR#, P_SERR#, P_FRAME#, P_IRDY#,
P_TRDY#, P_LOCK#, P_DEVSEL#, P_STOP#, P_IDSEL, S1_AD, S1_CBE#,
S1_PAR, S1_PERR#, S1_SERR#, S1_FRAME#, S1_IRDY#, S1_TRDY#,
S1_LOCK#, S1_devsel#, S1_STOP#, S2_AD, S2_CBE#, S2_PAR, S2_PERR#,
S2_SERR#, S2_FRAME#, S2_IRDY#, S2_TRDY#, S2_LOCK#, S2_DEVSEL#,
and S2_STOP#.
4.
REQ# signals have a setup of 10 and GNT# signals have a setup of 12.
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PI7C7300ANA-E 制造商:Pericom Semiconductor Corporation 功能描述:PCI-to-PCI Bridge 272-Pin BGA 制造商:Pericom Semiconductor Corporation 功能描述:PCI to PCI Bridge 272-Pin BGA
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