參數(shù)資料
型號(hào)： PEB3086
廠商： INFINEON TECHNOLOGIES AG
英文描述： ISDN SUBSCRIBER ACCESS CONTROLLER
中文描述： ISDN用戶(hù)接入控制器
文件頁(yè)數(shù)： 30/262頁(yè)
文件大?。?/td> 3476K
代理商： PEB3086
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ISAC-SX
PEB 3086
Description of Functional Blocks
Data Sheet
30
2003-01-30
3
Description of Functional Blocks
3.1
General Functions and Device Architecture
Figure 4
shows the architecture of the ISAC-SX containing the following functions:
S/T-interface transceiver supporting the modes TE, LT-T, LT-S, NT and Intelligent NT
Different host interface modes:
- Parallel microcontroller interface
(Siemens/Intel multiplexed, Siemens/Intel non multiplexed, Motorola modes)
- Serial Control Interface (SCI)
Optional indirect register address mode reduces number of registers to be accessed
to two locations
One D-channel HDLC-controller with 64 byte FlFOs per direction with programmable
FIFO block size (threshold) of 4, 8, 16 or 32 byte for receive direction and 16 or 32
byte for transmit direction
Support of firmware download via one B-channel HDLC-controller and FlFOs with
reduced functionality
IOM-2 interface for terminal (TE mode), linecard (LT-T or LT-S) or NT applications
IOM handler with controller data access registers (CDA) allows flexible access to IOM
timeslots for reading/writing, looping and shifting data
Synchronous transfer interrupts (STI) allow controlled access to IOM timeslots
Flexible timeslot assignment of HDLC controllers on IOM for IDSL support
MONITOR channel handler on IOM-2 for master mode, slave mode or data exchange
C/I-channel handler and TIC bus access controller
D-channel access mechanism in all modes
D-channel priority handler on IOM-2 for intelligent NT applications
Capability to control the start of the multiframe for synchronization from external
signals (M-bit input pin in LT-S/NT mode, M-bit output pin in TE, LT-T mode)
Auxiliary interface with interrupt and general purpose I/O lines and 2 LED drivers
LED connected to pin ACL indicates S-interface activation status automatically or can
be controlled by the host
Level detect circuit on the S interface reduces power consumption in power down
mode
Two timers for periodic or single interrupts (periods between 1 ms and 14.336 s)
Clock and timing generation
Digital PLL to synchronize the transceiver to the S/T interface
Buffered 7.68 MHz oscillator clock output allows connection of further devices and
saves another crystal on the system board
Reset generation (watchdog timer)
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PEB3086HV1.4 功能描述:ISDN 接口 ISDN RoHS:否 制造商:Texas Instruments 封裝:Tube
PEB3164FV1.1 功能描述:接口—CODEC CODEC & SLIC RoHS:否 制造商:Texas Instruments 類(lèi)型: 分辨率: 轉(zhuǎn)換速率:48 kSPs 接口類(lèi)型:I2C ADC 數(shù)量:2 DAC 數(shù)量:4 工作電源電壓:1.8 V, 2.1 V, 2.3 V to 5.5 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DSBGA-81 封裝:Reel
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