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參數(shù)資料
| 型號(hào)： | PCI9060 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | 12O COMPATIBLE PCI BUS MASTER INTERFACE CHIP FOR ADAPTERS AND EMBEDDED SYSTEMS |
| 中文描述： | 12O兼容的PCI總線主控接口芯片的適配器和嵌入式系統(tǒng) |
| 文件頁數(shù)： | 33/192頁 |
| 文件大?。?/td> | 1551K |
| 代理商： | PCI9060 |
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SECTION 3
PCI 9080
FUNCTIONAL DESCRIPTION
PLX Technology, Inc., 1997
Page 24
Version 1.02
case when the Local Bus Latency Timer is enabled and
expires. (Refer to Figure 3-11 and Figure 3-12.)
; >; ,<
; -.
'
'
)
)=>) ;
&(); <);
-.
; >
Figure 3-11. Direct Slave Write
For direct slave writes, the PCI (Master) writes data to
the local bus (slave). Direct Slave is the “Command from
the PCI host,” which has the highest priority. Direct
Slave or Direct Master pre-empts DMA; however, Direct
Slave does not pre-empt Direct Master (refer to Section
3.6.2.3.1, “Backoff”).
; >; ,<;
>
; -
.
'
'
);
)=>)
&(); <);
-.
Figure 3-12. Direct Slave Read
For direct slave reads, the PCI (Master) reads data from
the local bus (Slave).
PCI 9080 supports on-the-fly Endian conversion for
Space 0, Space 1, and expansion ROM space. The local
bus can be Big/Little Endian by either using the
BIGEND# input pin or the programmable internal register
configuration. When BIGEND# is asserted, it overwrites
the internal register configuration.
Note:
PCI bus is always Little Endian.
3.6.2.2 PCI to Local Address Mapping
Note:
Not applicable if I
2
O mode.
Three local address spaces—Space 0, Space 1, and
expansion ROM—are accessible from the PCI bus. Each
is defined by a set of three registers:
Local Address Range
Local Base Address
PCI Base Address
A fourth register, Bus Region Descriptor Register for PCI
to local accesses, defines the local bus characteristics
for both regions. (Refer to Figure 3-13.)
3.6.2.2.1 Byte Enables
LBE[3:0]# (pins 139-142) are encoded based on the
configured bus width, as follows:
32-Bit Bus
—For a 32-bit bus, the four byte enables
indicate which of the four bytes are active during a data
cycle.
BE3# Byte Enable 3—LD[31:24]
BE2# Byte Enable 2—LD[23:16]
BE1# Byte Enable 1—LD[15:8]
BE0# Byte Enable 0—LD[7:0]
16-Bit Bus
—For a 16-bit bus, BE3#, BE1# and BE0#
are encoded to provide BHE#, LA1, and BLE#,
respectively.
BE3# Byte High Enable (BHE#)—LD[15:8]
BE2# not used
BE1# Address bit 1 (LA1)
BE0# Byte Low Enable (BLE#)— LD[7:0]
8-Bit Bus
—For an 8-bit bus, BE1# and BE0# are
encoded to provide LA1 and LA0, respectively.
BE3# not used
BE2# not used
BE1# Address bit 1 (LA1)
BE0# Address bit 0 (LA0)
Each PCI to Local Address space is defined as part of
reset initialization as described in the next section.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PCI9080 | 12O COMPATIBLE PCI BUS MASTER INTERFACE CHIP FOR ADAPTERS AND EMBEDDED SYSTEMS |
| PCI9060ES | 12O COMPATIBLE PCI BUS MASTER INTERFACE CHIP FOR ADAPTERS AND EMBEDDED SYSTEMS |
| PCI9060SD | 12O COMPATIBLE PCI BUS MASTER INTERFACE CHIP FOR ADAPTERS AND EMBEDDED SYSTEMS |
| PCI950PT | PC Card Support |
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參數(shù)描述 |
|---|---|
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| PCI9060-3A | 制造商:PLX Technology 功能描述: |
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