- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄367800 > PC755M8 PC755M8 [Updated 6/03. 35 Pages] 32-bit RISC PowerPC-based Multichip Module PDF資料下載
參數(shù)資料
| 型號： | PC755M8 |
| 英文描述： | PC755M8 [Updated 6/03. 35 Pages] 32-bit RISC PowerPC-based Multichip Module |
| 中文描述： | PC755M8 [更新6月3日。 35頁] 32位RISC PowerPC的多芯片模塊 |
| 文件頁數(shù)： | 4/50頁 |
| 文件大?。?/td> | 1064K |
| 代理商： | PC755M8 |
第1頁第2頁第3頁當前第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁
4
PC755/745
2138D–HIREL–06/03
–
–
–
Floating-point Unit and a 32-entry FPR File
–
Support for IEEE-754 standard single and double precision floating point
arithmetic
–
Hardware support for divide
–
Hardware support for denormalized numbers
–
Single-entry reservation station
–
Supports non-IEEE mode for time-critical operations
System Unit
–
Executes CR logical instructions and miscellaneous system instructions
–
Special register transfer instructions
Load/Store Unit
–
One cycle load or store cache access (byte, half-word, word, double-word)
–
Effective address generation
–
Hits under misses (one outstanding miss)
–
Single-cycle unaligned access within double word boundary
–
Alignment, zero padding, sign extend for integer register file
–
Floating point internal format conversion (alignment, normalization)
–
Sequencing for load/store multiples and string operations
–
Store gathering
–
Cache and TLB instructions
–
Big and Little-endian byte addressing supported
–
Misaligned Little-endian supported
–
Level 1 Cache structure
–
32K, 32 bytes line, 8-way set associative instruction cache (iL1)
–
32K, 32 bytes line, 8-way set associative data cache (dL1)
–
Cache locking for both instruction and data caches, selectable by group of
ways
–
Single-cycle cache access
–
Pseudo least-recently used (PLRU) replacement
–
Copy-back or Write Through data cache (on a page per page basis)
–
Supports all PowerPC memory coherency modes
–
Non-Blocking instruction and data cache (one outstanding miss under hits)
–
No snooping of instruction cache
Level 2 (L2) Cache Interface (not implemented on PC745)
–
Internal L2 cache controller and tags; external data SRAMs
–
256K, 512K, and 1-Mbyte 2-way set associative L2 cache support
–
Copyback or write-through data cache (on a page basis, or for all L2)
–
Instruction-only mode and data-only mode.
–
64 bytes (256K/512K) or 128 bytes (1M) sectored line size
Single-cycle arithmetic, shifts, rotates, logical
Multiply and divide support (multi-cycle)
Early out multiply
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PC755CMGHU300LE | PowerPC 755/745 RISC Microprocessor |
| PC755CMGHU350LE | PowerPC 755/745 RISC Microprocessor |
| PC755CMGHU366LE | PowerPC 755/745 RISC Microprocessor |
| PC755CMGHU400LE | PowerPC 755/745 RISC Microprocessor |
| PC755CMGSU300LE | PowerPC 755/745 RISC Microprocessor |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PC75B | 制造商:Datak Corporation 功能描述: |
| PC75-C | 功能描述:PCB COPPER CLAD 4.5X7" 2 SIDE RoHS:是 類別:原型開發(fā)產(chǎn)品 >> 原型開發(fā)板 - 未穿孔 系列:- 標準包裝:5 系列:500 原型板類型:包銅，無涂層 尺寸/尺寸:36.00" x 24.00"（914.4mm x 609.6mm） 板厚度:0.063"（1.60mm）1/16" 材質(zhì):雙面包銅 FR4，1 盎斯 |
| PC75P | 功能描述:PCB COPPER CLAD POS 4 X 6"2 SIDE RoHS:是 類別:原型開發(fā)產(chǎn)品 >> 原型開發(fā)板 - 未穿孔 系列:- 標準包裝:5 系列:500 原型板類型:包銅，無涂層 尺寸/尺寸:36.00" x 24.00"（914.4mm x 609.6mm） 板厚度:0.063"（1.60mm）1/16" 材質(zhì):雙面包銅 FR4，1 盎斯 |
| PC75P-C | 功能描述:PCB COPPER CLAD POS 4.5X7"2 SIDE RoHS:是 類別:原型開發(fā)產(chǎn)品 >> 原型開發(fā)板 - 未穿孔 系列:- 標準包裝:5 系列:500 原型板類型:包銅，無涂層 尺寸/尺寸:36.00" x 24.00"（914.4mm x 609.6mm） 板厚度:0.063"（1.60mm）1/16" 材質(zhì):雙面包銅 FR4，1 盎斯 |
| PC75P-S | 功能描述:PCB COPPER CLAD POS 6 X 6"2 SIDE RoHS:是 類別:原型開發(fā)產(chǎn)品 >> 原型開發(fā)板 - 未穿孔 系列:- 標準包裝:5 系列:500 原型板類型:包銅，無涂層 尺寸/尺寸:36.00" x 24.00"（914.4mm x 609.6mm） 板厚度:0.063"（1.60mm）1/16" 材質(zhì):雙面包銅 FR4，1 盎斯 |
發(fā)布緊急采購，3分鐘左右您將得到回復。