參數(shù)資料
型號(hào)： MPC823ZT50
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, RISC PROCESSOR, PBGA256
封裝： 23 X 23 MM, 1.27 MM PITCH, PLASTIC, BGA-256
文件頁(yè)數(shù)： 336/1407頁(yè)
文件大小： 13074K
代理商： MPC823ZT50
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External Signals
MOTOROLA
MPC823 USER’S MANUAL
2-3
EXTERNAL
SIGNALS
2
TA
A12
Transfer Acknowledge—This bidirectional three-state signal indicates that the
slave device addressed in the current transaction has accepted the data transferred
by the master (write) or has driven the data bus with valid data (read). The signal
behaves as an output when the PCMCIA memory controller takes control of the
transaction. The only exception occurs when the memory controller is controlling the
slave access by means of the GPCM and the corresponding option register is
instructed to wait for an external assertion of the transfer acknowledge line. Every
slave device should negate the ta signal after the end of the transaction and
immediately three-state it to avoid contentions on the line if a new transfer is initiated
addressing other slave devices. A pull-up resistor should be connected to this signal
to keep a master device from detecting the assertion of this signal when no slave is
addressed in a transfer or when the address detection for the addressed slave is
slow.
TEA
C11
Transfer Error Acknowledge—This open-drain signal indicates that a bus error
occurred in the current transaction. It is driven asserted by the MPC823 when the bus
monitor does not detect a bus cycle termination within a reasonable amount of time.
The assertion of TEA causes the termination of the current bus cycle, thus ignoring
the state of TA.
BI
B12
Burst Inhibit—This bidirectional three-state signal indicates that the slave device
addressed in the current burst transaction is unable to support burst transfers. The
signal behaves as an output when the PCMCIA memory controller takes control of
the transaction. When the MPC823 drives out the signal for a specific transaction, it
asserts or negates BI during the transaction according to the value you specify in the
appropriate control registers. It negates the signal after the end of the transaction
and immediately three-states it to avoid contentions if a new transfer is initiated
addressing other slave devices.
RSV
IRQ2
D9
Reservation—This three-state signal is output by the MPC823 in conjunction with
the address bus to indicate that the internal core initiated a transfer as a result of a
stwcx or lwarx instruction.
Interrupt Request 2—This input is one of the eight external signals that can request
(by means of the internal interrupt controller) a service routine from the core.
IRQ4
KR
RETRY
SPKROUT
B7
Interrupt Request 4—This input signal is one of the eight external signals that can
request (by means of the internal interrupt controller) a service routine from the core.
It should be noted that the interrupt request signal that is sent to the interrupt
controller is the logical AND of this signal (if defined to function as IRQ4) and the
DP1/IRQ4 (if defined to function as IRQ4).
Kill Reservation—This input is used as a part of the storage reservation protocol
when the MPC823 initiated a transaction as the result of a stwcx instruction.
Retry—This input is used by the slave device to indicate that it is unable to accept
the transaction. The MPC823 has to relinquish the ownership of the bus and initiate
the transaction again after winning again in the bus arbitration.
Speaker Out—This output signal is used to provide a digital audio waveform to be
driven to the system’s speaker.
D[0:31)
See Table 2-2
for pin
breakout.
Data Bus—This bidirectional three-state signal provides the general-purpose data
path between the MPC823 and all other devices. Although the data path is a
maximum of 32 bits wide, it can be dynamically sized to support 8-, 16-, or 32-bit
transfers. D0 is the most-significant bit of the data bus.
DP0
IRQ3
C3
Data Parity 0—This bidirectional three-state signal provides parity generation and
checking for the data bus lane D[0:7] by transferring to a slave device initiated by the
MPC823. The parity function can be defined independently for each one of the
addressed memory banks (if controlled by the memory controller) and for the rest of
the slaves sitting on the external bus.
Interrupt Request 3—This input signal is one of the eight external signals that can
request (by means of the internal interrupt controller) a service routine from the core.
DP1
IRQ4
D4
Data Parity 1—This bidirectional three-state signal provides parity generation and
checking for the data bus lane D[8:15] by transferring to a slave device initiated by
the MPC823. The parity function can be defined independently for each one of the
addressed memory banks (if controlled by the memory controller) and for the rest of
the slaves on the external bus.
Interrupt Request 4—This input is one of the eight external lines that can request
(by means of the internal interrupt controller) a service routine from the core. It should
be noted that the interrupt request signal that is sent to the interrupt controller is the
logical AND of this signal (if defined to function as IRQ4) and the KR/SPKROUT/
IRQ4 if defined to function as IRQ4.
Table 2-1. Signal Descriptions (Continued)
SIGNAL
PIN NUMBER
DESCRIPTION
相關(guān)PDF資料
PDF描述
MPC823CZT25 32-BIT, RISC PROCESSOR, PBGA256
MPC823ZT25 32-BIT, RISC PROCESSOR, PBGA256
MPC8241LVR200X 32-BIT, 200 MHz, RISC PROCESSOR, PBGA357
MPC8241LVR166X 32-BIT, 166 MHz, RISC PROCESSOR, PBGA357
MPC8241LVR266D 32-BIT, 266 MHz, RISC PROCESSOR, PBGA357
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MPC8240 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Integrated Processor Hardware Specifications
MPC8240EC 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Integrated Processor Hardware Specifications
MPC8241 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Intergrated Processor Hardware Specifications
MPC8241EC 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC8241 Integrated Processor Hardware Specifications
MPC8241LVR166D 功能描述:微處理器 - MPU INTEGRATED HOST PROC RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
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