參數(shù)資料
型號(hào)： MPC823ZT50
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, RISC PROCESSOR, PBGA256
封裝： 23 X 23 MM, 1.27 MM PITCH, PLASTIC, BGA-256
文件頁數(shù)： 1176/1407頁
文件大?。?/td> 13074K
代理商： MPC823ZT50
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Communication Processor Module
MOTOROLA
MPC823 USER’S MANUAL
16-271
SCC2
COMMUNICATION
16
PROCESSOR
MODULE
You can program the CPM command register (CPCR) with the following commands to
receive data. After the hardware or software is reset and the channel is enabled by its
SCCM–ASYNC HDLC register, the channel is in receive enable mode and uses the first
buffer descriptor in the table.
ENTER HUNT MODE
—This command is used to force the SCC2 ASYNC HDLC
controller to close the current RX buffer descriptor if it is being used and enter hunt
mode. The controller continues receiving after it finds a frame preceded by one or more
opening flags.
CLOSE RX BD—This command is not supported by the SCC2 ASYNC HDLC
controller.
INIT RX PARAMETERS—This command initializes all the receive parameters in this
serial channel’s parameter RAM to their reset state and should only be issued when the
receiver is disabled. The INIT TX AND RX PARAMS command can also be used to
reset the receive and transmit parameters.
16.9.19.11 SCC2 ASYNC HDLC CONTROLLER ERRORS. The SCC2 ASYNC HDLC
controller reports frame reception and transmission error conditions using the channel buffer
descriptors and the SCC2 ASYNC HDLC event register. The following transmission error
can be detected by the SCC2 ASYNC HDLC controller.
CTS Lost During Frame Transmission Error—When this error occurs, the channel stops
transmitting the buffer, closes it, sets the CT bit in the TX buffer descriptor and the TXE
bit in the SCCE–ASYNC HDLC. The channel continues transmitting from the next TX
buffer descriptor after the RESTART TRANSMIT command is issued.
The following reception errors can be detected by the SCC2 ASYNC HDLC controller.
Overrun Error—The SCC2 ASYNC HDLC controller maintains an internal 8-byte FIFO
when the serial communication controller receives data. A receive overrun occurs when
the communication processor module is unable to keep up with the data rate or the
SDMA channel is unable to write the received data to memory. The previous data byte
and the frame status are lost. The controller closes the buffer with the OV bit in the
buffer descriptor set and sets the RXF bit in the SCCE–ASYNC HDLC register. The
receiver then searches for the next frame.
CD Lost During Frame Reception Error—When this error occurs, the channel stops
receiving frames, closes the buffer, and sets the CD bit in the buffer descriptor and the
RXF bit in the SCCE–ASYNC HDLC register. This error has the highest priority. The
rest of the frame is lost and other errors are not checked in that frame. The receiver then
searches for the next frame once the CD signal is reasserted.
Abort Sequence Error—This error occurs when the SCC2 ASYNC HDLC controller
receives an abort sequence. At that time, the channel closes the buffer by setting the
RX AB bit in the buffer descriptor and sets the RXF bit in the SCCE–ASYNC HDLC
register. The CRC error status condition is not checked on aborted frames. If the abort
sequence is received and no frame is currently being received, the next buffer
descriptor is opened and then closed with the AB bit set in the buffer descriptor.
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參數(shù)描述
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MPC8240EC 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Integrated Processor Hardware Specifications
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MPC8241EC 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC8241 Integrated Processor Hardware Specifications
MPC8241LVR166D 功能描述:微處理器 - MPU INTEGRATED HOST PROC RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
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