參數(shù)資料
型號： MPC823ZT50
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, RISC PROCESSOR, PBGA256
封裝： 23 X 23 MM, 1.27 MM PITCH, PLASTIC, BGA-256
文件頁數(shù)： 1078/1407頁
文件大?。?/td> 13074K
代理商： MPC823ZT50
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Communication Processor Module
16-182
MPC823 USER’S MANUAL
MOTOROLA
SCC2
COMMUNICATION
16
PROCESSOR
MODULE
16.9.9 Initializing Serial Communication Controller
The serial communication controller requires that a number of registers and parameters be
configured after a power-on reset. Regardless of the protocol you are using, follow these
steps to initialize the serial communication controller:
1. Write the parallel I/O ports to configure and connect the I/O pins to the serial
communication controller.
2. The RAID field of the SDCR should be initialized with the appropriate arbitration ID.
3. Write the port C registers to configure the CTS and CD pins to be in parallel I/O with
interrupt capability or to be direct connections to the serial communication controller
(if modem support is needed).
4. If the time-slot assigner is used, the serial interface must be configured. If the serial
communication controller is used in NMSI mode, the SICR must still be initialized.
5. Write the GSMR_H and GSMR_L, but do not write the ENT or ENR bits yet.
6. Write the PSMR.
7. Write the DSR.
8. Initialize the required values for the serial communication controller in its parameter
RAM.
9. Clear out any current events in the SCCE register (optional).
10. Write the SCCM register to enable the interrupts in the SCCE register.
11. Write the CICR to configure the SCC2 interrupt priority.
12. Clear out any current interrupts in the CIPR (optional).
13. Write the CIMR to enable interrupts to the CPM interrupt controller.
14. Set the ENT and ENR bits in the GSMR_L.
The buffer descriptors can have their R or E bits set at any time. Notice that the CPCR does
not need to be accessed after a power-on reset. The serial communication controller should
be disabled and reenabled after any dynamic change in its parallel I/O ports or serial
channel physical interface configuration. A full reset using the RST bit in the CPCR is a
comprehensive reset that can also be implemented.
Follow these steps to handle an interrupt in the serial communication controller:
1. Once an interrupt occurs, read the SCCE register to find out which source has caused
the interrupt. The SCCE bits that are going to be “handled” in this interrupt handler
would normally be cleared at this time by writing ones to them.
2. Process the TX buffer descriptors to reuse them if the TX or TXE bit was set in the
SCCE register. If the transmit speed is fast or the interrupt delay is long, more than
one transmit buffer may have been sent by the serial communication controller. Thus,
it is important to check more than just one TX buffer descriptor during interrupt
handling. One common practice is to process all TX buffer descriptors in the interrupt
handler until one is found with its R bit set.
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MPC823CZT25 32-BIT, RISC PROCESSOR, PBGA256
MPC823ZT25 32-BIT, RISC PROCESSOR, PBGA256
MPC8241LVR200X 32-BIT, 200 MHz, RISC PROCESSOR, PBGA357
MPC8241LVR166X 32-BIT, 166 MHz, RISC PROCESSOR, PBGA357
MPC8241LVR266D 32-BIT, 266 MHz, RISC PROCESSOR, PBGA357
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MPC8240 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Integrated Processor Hardware Specifications
MPC8240EC 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Integrated Processor Hardware Specifications
MPC8241 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Intergrated Processor Hardware Specifications
MPC8241EC 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC8241 Integrated Processor Hardware Specifications
MPC8241LVR166D 功能描述:微處理器 - MPU INTEGRATED HOST PROC RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
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