MCF532x ColdFire Microprocessor Data Sheet, Rev. 5 Electrical Characteristics Fr" />
參數(shù)資料
型號(hào)： MCF5329CVM240
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 28/50頁(yè)
文件大小： 0K
描述： IC MCU 32BIT 240MHZ 256-MAPBGA
標(biāo)準(zhǔn)包裝： 90
系列： MCF532x
核心處理器： Coldfire V3
芯體尺寸： 32-位
速度： 240MHz
連通性： CAN，EBI/EMI，以太網(wǎng)，I²C，SPI，SSI，UART/USART，USB，USB OTG
外圍設(shè)備： DMA，LCD，PWM，WDT
輸入/輸出數(shù)： 94
程序存儲(chǔ)器類(lèi)型： ROMless
RAM 容量： 32K x 8
電壓 - 電源 (Vcc/Vdd)： 1.4 V ~ 3.6 V
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 256-LBGA
包裝： 托盤(pán)
MCF532x ColdFire Microprocessor Data Sheet, Rev. 5
Electrical Characteristics
Freescale Semiconductor
34
S6
SSI_BCLK to SSI_FS output invalid
-2
—
ns
S7
SSI_BCLK to SSI_TXD valid
—
15
ns
S8
SSI_BCLK to SSI_TXD invalid / high impedence
-4
—
ns
S9
SSI_RXD / SSI_FS input setup before SSI_BCLK
15
—
ns
S10
SSI_RXD / SSI_FS input hold after SSI_BCLK
0
—
ns
1 All timings specified with a capactive load of 25pF.
2 SSI_MCLK can be generated from SSI_CLKIN or a divided version of the internal system clock
(SYSCLK).
3 SSI_BCLK can be derived from SSI_CLKIN or a divided version of SYSCLK. If the SYSCLK is used, the
minimum divider is 6. If the SSI_CLKIN input is used, the programmable dividers must be set to ensure
that SSI_BCLK does not exceed 4 x fSYS.
Table 20. SSI Timing – Slave Modes1
1 All timings specified with a capactive load of 25pF.
Num
Description
Symbol
Min
Max
Units
S11
SSI_BCLK cycle time
tBCLK
8
× t
SYS
—ns
S12
SSI_BCLK pulse width high/low
45%
55%
tBCLK
S13
SSI_FS input setup before SSI_BCLK
10
—
ns
S14
SSI_FS input hold after SSI_BCLK
3
—
ns
S15
SSI_BCLK to SSI_TXD/SSI_FS output valid
—
15
ns
S16
SSI_BCLK to SSI_TXD/SSI_FS output invalid/high
impedence
-2
—
ns
S17
SSI_RXD setup before SSI_BCLK
10
—
ns
S18
SSI_RXD hold after SSI_BCLK
3
—
ns
Table 19. SSI Timing – Master Modes1 (continued)
Num
Description
Symbol
Min
Max
Units
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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