參數(shù)資料
型號(hào)： MCF5232
廠商： 飛思卡爾半導(dǎo)體(中國(guó))有限公司
英文描述： Integrated Microprocessor Hardware Specification
中文描述： 集成的微處理器，硬件規(guī)格
文件頁(yè)數(shù)： 46/60頁(yè)
文件大?。?/td> 1462K
代理商： MCF5232
MCF523x Integrated Microprocessor Hardware Specification, Rev. 1.3
Preliminary
Preliminary Electrical Characteristics
Freescale Semiconductor
46
Figure 14. SDRAM Read Cycle
Figure 15
shows an SDRAM write cycle.
Table 32. SDRAM Timing
NUM
Characteristic
Symbol
Min
Max
Unit
D1
CLKOUT high to SDRAM address valid
t
CHDAV
—
9
ns
D2
CLKOUT high to SDRAM control valid
t
CHDCV
—
9
ns
D3
CLKOUT high to SDRAM address invalid
t
CHDAI
1.5
—
ns
D4
CLKOUT high to SDRAM control invalid
t
CHDCI
1.5
—
ns
D5
SDRAM data valid to CLKOUT high
t
DDVCH
4
—
ns
D6
CLKOUT high to SDRAM data invalid
t
CHDDI
1.5
—
ns
D7
1
NOTES:
1
D7 and D8 are for write cycles only.
CLKOUT high to SDRAM data valid
t
CHDDVW
—
9
ns
D8
2
CLKOUT high to SDRAM data invalid
t
CHDDIW
1.5
—
ns
A[23:0]
RAS
D[31:0]
ACTV
NOP
PALL
NOP
RAS[1:0]
READ
Column
SD_CKE
0
SDWE
CAS[3:0]
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
D1
D2
D4
D6
D5
D4
D4
1
DACR[CASL] = 2
CAS
1
NOP
D4
Row
D3
D2
D2
D2
D2
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