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參數(shù)資料
| 型號： | MC68HC705JJ7CDW |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PDSO20 |
| 封裝： | SOIC-20 |
| 文件頁數(shù)： | 109/164頁 |
| 文件大?。?/td> | 1165K |
| 代理商： | MC68HC705JJ7CDW |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁當(dāng)前第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁
MC68HC705JJ7 MC68HC705JP7 Advance Information Data Sheet, Rev. 4.1
Freescale Semiconductor
49
Chapter 6
Operating Modes
6.1 Introduction
This section describes the operation of the device with respect to the oscillator source and the low-power
modes:
Stop mode
Wait mode
Halt mode
Data-retention mode
6.2 Oscillator Source
The microcontroller unit (MCU) can be clocked by either an internal low-power oscillator (LPO) without
external components or by an external pin oscillator (EPO) which uses external components. The enable
and selection of the clock source is determined by the state of the oscillator select bits (OM1 and OM2)
in the interrupt status and control register (ISCR) as shown in Figure 6-1.
IRQE — External Interrupt Request Enable Bit
This read/write bit enables external interrupts. Refer to Chapter 4 Interrupts for more details.
OM1 and OM2 — Oscillator Select Bits
These bits control the selection and enabling of the oscillator source for the MCU. One choice is the
internal LPO and the other oscillator is the EPO which is common to most M68HC05 MCU devices.
The EPO uses external components like filter capacitors and a crystal or ceramic resonator and
consumes more power than the LPO. The selection and enable conditions for these two oscillators are
shown in Table 6-1. Reset clears OM1 and sets OM2, which selects the LPO and disables the EPO.
Therefore, the lowest power is consumed when OM1 is cleared. The state with both OM1 and OM2
set is provided so that the EPO can be started up and allowed to stabilize while the LPO still clocks the
MCU.
Address:
$000D
Bit 7
654321
Bit 0
Read:
IRQE
OM2
OM1
0
IRQF
000
Write:
R
IRQR
Reset:
11000000
= Unimplemented
R
= Reserved
Figure 6-1. IRQ Status and Control Register (ISCR)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68HC705JJ7CP | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PDIP20 |
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