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參數(shù)資料
| 型號(hào)： | MC68HC11G5CFN |
| 廠商： | ABILIS SYSTEMS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQCC84 |
| 封裝： | PLASTIC, LCC-84 |
| 文件頁(yè)數(shù)： | 54/195頁(yè) |
| 文件大小： | 3620K |
| 代理商： | MC68HC11G5CFN |
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EVENT COUNTER
11-17
The following table applies to mode 0 only:
EVI2C
EVI2B
EVI2A
Clear input mode for EVCNT2
0
X
Not used
1
0
Falling edge of EVI2 (PH4)
1
0
1
Rising edge of EVI2 (PH4)
1
0
Logic HIGH (1) level on EVI2
1
Logic LOW (0) level on EVI2
In mode 0, EVI2 is used as a “clear” input to (EVCNT2).
Note:
In mode 2, these three bits should be reset to zero to allow PH4 to be used as an I/O port.
EVI1C, EVI1B, EVI1A — Event Input Select 1 (EVI1)
These three bits determine the operation of event input unit 1 as shown in the following
table.
The following table applies to modes 0, 1 and 2 only:
EVI1C
EVI1B
EVI1A
PH5
Clock Source
Count Mode
0
I/O
Count stop
0
1
I/O
Scaled E
Count always
0
1
0
EVI1
Scaled E
Inhibit counting on EVI1 = 0
0
1
EVI1
Scaled E
Inhibit counting on EVI1 = 1
1
0
EVI1
External
Count on falling edge of EVI1
1
0
1
EVI1
External
Count on rising edge of EVI1
1
X
EVI1
External
Count on both falling and
rising edges of EVI1
Note:
In mode 3, these three bits should be reset to zero to allow PH5 to be used as an I/O port.
11.6.3
Counters Enable/Interrupt Mask Register (EVMSK)
EVCEN
EV2I
EV1I
EVMSK
$1072
7
6
5
4
3
2
1
0
RESET:
READ:
Any time.
WRITE:
Any time.
RESET:
$00.
EVCEN — Event Counters Enable
0 – Event counters EVCNT1 and EVCNT2 are cleared. Also the event output (EVO)
is cleared to a logic low level (when EVPOL = 0 and EVOEN = 1). The EVCLK and
EVCTL registers should be written while this bit is “0”.
1 – Event counters are enabled.
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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