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參數(shù)資料
| 型號： | MB91F158PMC1 |
| 廠商： | FUJITSU LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | RISC MICROCONTROLLER, PQFP120 |
| 封裝： | 14 X 14 MM, 1.70 MM HEIGHT, 0.40 MM PITCH, PLASTIC, LQFP-120 |
| 文件頁數(shù)： | 77/92頁 |
| 文件大?。?/td> | 2193K |
| 代理商： | MB91F158PMC1 |
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MB91F158 Series
DS07-16316-2E
79
(7) Normal Bus Access and Read/Write Operations
(VCC
= 3.2 V to 3.5 V, VSS = AVSS = 0 V, TA = 0 °C to +70 °C)
*1 : If the bus is extended with either automatic wait insertion or RDY input, add the (tCYC
× the number of extended
cycles) time to this value.
*2 : This is the value at the time of (gear cycle
× 1) .
When the gear cycle is set to 1/2, 1/4 or 1/8, substitute “n” in the following formula with 1/2, 1/4 or 1/8 respectively.
Formula : (2
n / 2) × tCYC 40
Parameter
Symbol
Pin name
Condition
Value
Unit
Remarks
Min
Max
CS0 to CS3 delay time
tCHCSL
CLK,
CS0 to CS3
15
ns
CS0 to CS3 delay time
tCHCSH
15
ns
Address delay time
tCHAV
CLK,
A23 to A00
15
ns
Data delay time
tCHDV
CLK,
D31 to D16
15
ns
RD delay time
tCLRL
CLK,
RD
10
ns
RD delay time
tCLRH
10
ns
WR0 - WR1 delay time
tCLWL
CLK,
WR0, WR1
10
ns
WR0 - WR1 delay time
tCLWH
10
ns
Valid address
→
valid data input time
tAVDV
A23 to A00,
D31 to D16
3
/ 2 ×
tCYC
40
ns
*1, *2
RD
↓ → valid data input time
tRLDV
RD,
D31 to D16
tCYC
25
ns
*1
Data setup
→ RD ↑ time
tDSRH
25
ns
RD
↑ → data hold time
tRHDX
0
ns
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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