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參數(shù)資料
| 型號： | MB90T673 |
| 廠商： | Fujitsu Limited |
| 英文描述： | Quadruple Bus Buffer Gates With 3- State Outputs 14-CDIP -55 to 125 |
| 中文描述： | 16位微控制器專有 |
| 文件頁數(shù)： | 67/124頁 |
| 文件大小： | 2584K |
| 代理商： | MB90T673 |
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67
MB90670/675 Series
12. DTP/External Interrupt Circuit
The DTP (Data Transfer Peripheral)/external interrupt circuit is located between peripheral equipment connected
externally and the F
2
MC-16L CPU and transmits interrupt requests or data transfer requests generated by
peripheral equipment to the CPU, generates external interrupt request and starts the extended intelligent I/O
service (EI
2
OS).
(1) Register Configuration
DTP/interrupt factor register (EIRR)
Address
000029
H
bit 7 . . . . .. . . . . . .
—
—
—
—
ER3
ER2
ER1
ER0
bit 15
bit 14
bit 13
bit 12
bit 11
bit 10
bit 9
bit 8
(ENIR)
Initial value
- - - - 0000
B
—
—
—
—
R/W
R/W
R/W
R/W
Address
000028
H
bit 15 . . . . .. . . . . . .
—
—
—
—
EN3
EN2
EN1
EN0
(EIRR)
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
—
—
—
—
R/W
R/W
R/W
R/W
Initial value
- - - - 0000
B
Address
00002A
H
bit 15 . . . . .. . . . . . .
LB3
LA3
LB2
LA2
LB1
LA1
LB0
LA0
(Vacancy)
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
Initial value
00000000
B
DTP/interrupt enable register (ENIR)
Request level setting register (ELVR)
R/W: Readable and writable
— : Unused
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MB90T673PF | 16-Bit Buffers/Drivers With 3-State Outputs 48-CFP -55 to 125 |
| MB90678 | 16-bit Proprietary Microcontroller |
| MB90T673PFV | 16-Bit Bus Transceivers With 3-State Outputs 48-CFP -55 to 125 |
| MB90T678PF | 16-BIT BUFFERS/DRIVERS WITH 3-STATE OUTPUTS 48-CFP -55 to 125 |
| MB90T678PFV | 16-bit Proprietary Microcontroller |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MB90V340A-102CR | 制造商:FUJITSU 功能描述: |
| MB-910 | 制造商:Circuit Test 功能描述:BREADBOARD WIRING KIT - 350 PCS |
| MB9100100 | 制造商:COM/DUO 功能描述:FAN 4-6WKS |
| MB9100-100 | 制造商:COM/DUO 功能描述:FAN 4-6WKS |
| MB91101 | 制造商:Panasonic Industrial Company 功能描述:IC |
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