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參數(shù)資料
| 型號： | MB90F337PFM |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, FLASH, 24 MHz, MICROCONTROLLER, PQFP64 |
| 封裝： | 12 X 12 MM, 1.70 MM HEIGHT, 0.65 MM PITCH, PLASTIC, LQFP-64 |
| 文件頁數(shù)： | 52/92頁 |
| 文件大小： | 858K |
| 代理商： | MB90F337PFM |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁當前第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁
MB90335 Series
56
13.
DMAC
DMAC is simple DMA with the function equal with EI2OS. It has 16 channels DMA transfer channels with the
following features.
Performs automatic data transfer between the peripheral resource (I/O) and memory
The program execution of CPU stops in the DMA startup
Capable of selecting whether to increment the transfer source and destination addresses
DMA transfer is controlled by the DMA enable register, DMA stop status register, DMA status register and
descriptor
A STOP request is available for stopping DMA transfer from the resource
Upon completion of DMA transfer, the flag bit corresponding to the transfer completed channel in the DMA
status register is set and a termination interrupt is output to the transfer controller.
Register list
(Continued)
DMA enable register upper (DERH)
DMA enable register lower (DERL)
DMA stop status register (DSSR)
DMA status register upper (DSRH)
DMA status register lower (DSRL)
DMA descriptor channel specification register (DCSR)
* : The DSSR is lower when the STP bit of DCSR in the DSSR is “0”.
The DSSR is upper when the STP bit of DCSR in the DSSR is “1”.
Initial Value
Address : 0000ADH
00000000B
Initial Value
Address : 0000ACH
00000000B
Initial Value
Address : 0000A4H
00000000B
*
Initial Value
Address : 00009DH
00000000B
Initial Value
Address : 00009CH
00000000B
Initial Value
Address : 00009BH
00000000B
( R/W )
15
14
13
12
11
10
9
8
EN14
( R/W )
EN15
EN13
EN12
EN11
EN10
EN9
EN8
( R/W )
76
5
4
3
2
1
0
EN6
( R/W )
EN7
EN5
EN4
EN3
EN2
EN1
EN0
76
5
4
3
2
1
0
STP6
STP14
STP7
STP15
STP5
STP13
STP4
STP12
STP3
STP11
STP2
STP10
STP1
STP9
STP0
STP8
( R/W )
15
14
13
12
11
10
9
8
DTE14
DTE15
DTE13
DTE12
DTE11
DTE10
DTE9
DTE8
( R/W )
7654
32
1
0
DTE6
( R/W )
DTE7
DTE5
DTE4
DTE3
DTE2
DTE1
DTE0
( R/W )
76
54
3
2
1
0
( R/W )
STP
DCSR3 DCSR2 DCSR1 DCSR0
Reserved Reserved Reserved
相關PDF資料 |
PDF描述 |
|---|---|
| MB90352SPFV | 16-BIT, FLASH, 24 MHz, MICROCONTROLLER, PQFP64 |
| MB90F352SPFV | 16-BIT, FLASH, 24 MHz, MICROCONTROLLER, PQFP64 |
| MB90F352PFV | 16-BIT, FLASH, 24 MHz, MICROCONTROLLER, PQFP64 |
| MB90352CSPFV | 16-BIT, FLASH, 24 MHz, MICROCONTROLLER, PQFP64 |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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| MB90F342ASPF-GS-E1 | 制造商:FUJITSU 功能描述: |
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| MB90F342CAPFR-GSE1 | 制造商:FUJITSU 功能描述: |
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