參數資料
型號： MA330013
廠商： Microchip Technology
文件頁數： 43/199頁
文件大小： 0K
描述： MODULE PLUG-IN DSPIC33 100TQFP
標準包裝： 1
附件類型： 插拔式模塊（PIM）- dsPIC33FJ256MC710
適用于相關產品： Explorer 16（DM240001 或 DM240002）
產品目錄頁面： 658 (CN2011-ZH PDF)
配用： DM330023-ND - BOARD DEV DSPICDEM MCHV
相關產品： DSPIC33FJ64MC710T-I/PT-ND - IC DSPIC MCU/DSP 64K 100TQFP
DSPIC33FJ64MC710T-I/PF-ND - IC DSPIC MCU/DSP 64K 100TQFP
DSPIC33FJ64MC510T-I/PT-ND - IC DSPIC MCU/DSP 64K 100TQFP
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DSPIC33FJ256MC510T-I/PT-ND - IC DSPIC MCU/DSP 256K 100TQFP
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2007 Microchip Technology Inc.
Preliminary
DS70165E-page 135
dsPIC33F
7.0
DIRECT MEMORY ACCESS
(DMA)
Direct Memory Access (DMA) is a very efficient
mechanism of copying data between peripheral SFRs
(e.g., UART Receive register, Input Capture 1 buffer),
and buffers or variables stored in RAM, with minimal
CPU
intervention.
The
DMA
controller
can
automatically copy entire blocks of data without
requiring the user software to read or write the
peripheral Special Function Registers (SFRs) every
time a peripheral interrupt occurs. The DMA controller
uses a dedicated bus for data transfers and therefore,
does not steal cycles from the code execution flow of
the
CPU.
To
exploit
the
DMA
capability,
the
corresponding user buffers or variables must be
located in DMA RAM.
The dsPIC33F peripherals that can utilize DMA are
listed in Table 7-1 along with their associated Interrupt
Request (IRQ) numbers.
TABLE 7-1:
PERIPHERALS WITH DMA
SUPPORT
The DMA controller features eight identical data
transfer channels.
Each channel has its own set of control and status
registers. Each DMA channel can be configured to
copy data either from buffers stored in dual port DMA
RAM to peripheral SFRs, or from peripheral SFRs to
buffers in DMA RAM.
The DMA controller supports the following features:
Word or byte sized data transfers.
Transfers from peripheral to DMA RAM or DMA
RAM to peripheral.
Indirect Addressing of DMA RAM locations with or
without automatic post-increment.
Peripheral Indirect Addressing – In some periph-
erals, the DMA RAM read/write addresses may
be partially derived from the peripheral.
One-Shot Block Transfers – Terminating DMA
transfer after one block transfer.
Continuous Block Transfers – Reloading DMA
RAM buffer start address after every block
transfer is complete.
Ping-Pong Mode – Switching between two DMA
RAM start addresses between successive block
transfers, thereby filling two buffers alternately.
Automatic or manual initiation of block transfers
Each channel can select from 20 possible
sources of data sources or destinations.
For each DMA channel, a DMA interrupt request is
generated
when
a
block
transfer
is
complete.
Alternatively, an interrupt can be generated when half of
the block has been filled.
Note:
This data sheet summarizes the features
of this group of dsPIC33F devices. It is not
intended to be a comprehensive reference
source. To complement the information in
this data sheet, refer to the “dsPIC30F
Family Reference Manual” (DS70046).
Peripheral
IRQ Number
INT0
0
Input Capture 1
1
Input Capture 2
5
Output Compare 1
2
Output Compare 2
6
Timer2
7
Timer3
8
SPI1
10
SPI2
33
UART1 Reception
11
UART1 Transmission
12
UART2 Reception
30
UART2 Transmission
31
ADC1
13
ADC2
21
DCI
60
ECAN1 Reception
34
ECAN1 Transmission
70
ECAN2 Reception
55
ECAN2 Transmission
71
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PDF描述
ACM06DRUH CONN EDGECARD 12POS .156 DIP SLD
MA180013 MODULE PLUG-IN 18F45J10 44TQFP
VE-JW1-EY CONVERTER MOD DC/DC 12V 50W
GEM06DTBN-S664 CONN EDGECARD 12POS R/A .156 SLD
AC162057 MPLAB ICD 2 HEADER 14DIP
相關代理商/技術參數
參數描述
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MA330016 功能描述:子卡和OEM板 dsPIC33F GP RoHS:否 制造商:BeagleBoard by CircuitCo 產品:BeagleBone LCD4 Boards 用于:BeagleBone - BB-Bone - Open Source Development Kit
MA330017 功能描述:子卡和OEM板 dsPIC33F MC RoHS:否 制造商:BeagleBoard by CircuitCo 產品:BeagleBone LCD4 Boards 用于:BeagleBone - BB-Bone - Open Source Development Kit
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