參數(shù)資料
型號(hào): LPC47S42X
廠商: SMSC Corporation
英文描述: ENHANCED SUPER I/O WITH LPC INTERFACE FOR SERVER APPLICATIONS
中文描述: 增強(qiáng)的超級(jí)I /英國(guó)防損為服務(wù)器應(yīng)用接口?
文件頁(yè)數(shù): 157/264頁(yè)
文件大?。?/td> 1342K
代理商: LPC47S42X
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Bit 1 LAB
Lost Arbitration Bit. This bit is set when, in multi-master operation, arbitration is lost to another master
on the SMBus.
Bit 0 nBB
Bus Busy bit. This is a read-only flag indicating when the SMBus is in use. A zero indicates that the
bus is busy, and access is not possible. This bit is set/reset (logic “1”/logic “0”) by Start/Stop conditions.
Own Address Register
When the chip is addressed as slave, this register must be loaded with the 7-bit SMBus address to
which the chip is to respond. During initialization, the own address register must be written to,
regardless whether it is later used. The Addressed As Slave (AAS) bit in status register is set when this
address is received (the value in the data register is compared with the value in own address register).
Note that the data and own address registers are offset by one bit; hence, programming the own
address register with a value of 55h will result in the value AAh being recognized as the chip’s SMBus
slave address.
After reset, own address register has default address 00h.
Table 53 - SMBus Own Address Register (SMBus Base Address +1)
OWN ADDR
Bit
D7
D6
D5
Type
R/W
R/W
R/W
Default = 0x00
on VTR POR,
VCC POR,
Hard Reset or
Soft Reset
Data Shift Register
The Data Register acts as serial shift register and read buffer interfacing to the SMBus. All read and
write operations to/from the SMBus are done via this register. SMBus data is always shifted in or out of
shift register.
In receiver mode the SMBus data is shifted into the shift register until the acknowledge phase. Further
reception of data is inhibited (SCLK pin held low) until the data shift register is read.
In the transmitter mode data is transmitted to the SMBus as soon as it is written to the shift register if
the serial I/O is enabled (ESO=1).
157
D4
R/W
Slave
Addr 4
D3
R/W
Slave
Addr 3
D2
R/W
Slave
Addr 2
D1
R/W
Slave
Addr 1
D0
R/W
Slave
Addr 0
Bit Def
Reser
ved
Slave
Addr 6
Slave
Addr 5
相關(guān)PDF資料
PDF描述
LPC47M141-NC 128 PIN ENGANCED SUPER I/O CONTROLLER WITH AN LPC INTERFACE AND USB HUB
LPC47M142-NC 128 PIN ENGANCED SUPER I/O CONTROLLER WITH AN LPC INTERFACE AND USB HUB
LPC47M144-NC 128 PIN ENGANCED SUPER I/O CONTROLLER WITH AN LPC INTERFACE AND USB HUB
LPC47M145-NC e2 Rechargeable Nickel Metal Hydride Battery; Voltage Rating:1.2V; Battery Size Code:AA; Battery Capacity:2500mAh; Battery Terminals:Pressure Contact; Diameter:14.5mm; Height:50.5mm
LPC47M146-NC 128 PIN ENGANCED SUPER I/O CONTROLLER WITH AN LPC INTERFACE AND USB HUB
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參數(shù)描述
LPC47S457-NC 功能描述:輸入/輸出控制器接口集成電路 Enhanced Super I/O Controller RoHS:否 制造商:Silicon Labs 產(chǎn)品: 輸入/輸出端數(shù)量: 工作電源電壓: 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-64 封裝:Tray
LPC47S457-NS 功能描述:接口 - 專(zhuān)用 Enhanced Super I/O Controller RoHS:否 制造商:Texas Instruments 產(chǎn)品類(lèi)型:1080p60 Image Sensor Receiver 工作電源電壓:1.8 V 電源電流:89 mA 最大功率耗散: 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:BGA-59
LPC47S45X 制造商:SMSC 制造商全稱(chēng):SMSC 功能描述:Advanced I/O with X-Bus Interface
LPC47S45X_07 制造商:SMSC 制造商全稱(chēng):SMSC 功能描述:Advanced I/O with X-Bus Interface
LPC47U322QFP 制造商:Rochester Electronics LLC 功能描述:- Bulk