參數(shù)資料
型號： L64364
廠商： LSI Corporation
英文描述： Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片)
中文描述： 高度集成的自動柜員機(jī)分段和重組（SAR）的網(wǎng)絡(luò)應(yīng)用（用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片優(yōu)化引擎）
文件頁數(shù)： 268/444頁
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代理商： L64364
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6-28
ATM Cell Interface
6.7.5 HEC Generation
When the
ACI_HEC
bit in the ACI_Ctrl register (
page 6-10
) is set, the ACI
Transmitter generates the HEC byte and inserts it after the cell header.
Depending on the state of the
ACI_CellSize
bits, the ACI Transmitter
outputs 53, 57, 61, or 65 bytes per cell.
When the
ACI_HEC
bit is cleared, the ACI Transmitter does not generate
an HEC byte and, depending on the state of the
ACI_CellSize
bits, the
ACI Transmitter outputs 52, 56, 60, or 64 bytes per cell.
The ACI_BadHEC register can be used to generate bad HECs for
diagnostic purposes. This feature can be targeted to a specific PHY. The
format of the ACI_BadHec register is shown in
Figure 6.8
.
6.7.6 CRC10 Generation
When the
CDS_Crc10
bit in the Cell Descriptor (
page 6-5
) is set, the ACI
Transmitter generates 10 bits of CRC10 out of the first 374 bits of cell
payload and replaces the last 10 bits of the cell payload with the
calculated CRC10.
6.7.7 ACI Transmitter Time-Out
When the destination PHY device is not ready to receive a cell, the ACI
Transmitter stalls. To prevent a malfunctioning PHY device from blocking
other PHY devices, the cell at the head of the transmit FIFO is discarded
when the ACI Transmit Timer reaches time-out.
If the ACI Transmitter stalls because a PHY device is not ready, it loads
the contents of the ACI_TxTimer register (see
Section 6.4.3,
“ACI_TxTimer Register,” page 6-13
) into the ACI Transmit Timer. The
Timer decrements using a system clock or a timeout event of a general-
purpose timer. After the ACI Transmit Timer decrements to 0, the ACI
Transmitter removes the cell at the head of the Transmit FIFO.
The ACI Transmitter places the discarded cell in the ACI Error FIFO from
which the APU may retrieve it by reading the ACI_Error register.
Subsequent sequential cells that are also queued for the same PHY port
are also placed in the ACI Error FIFO, providing
Tx_Clav
(
page 3-12
) is
not asserted.
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