- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄377598 > L64364 (LSI Corporation) Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片) PDF資料下載
參數(shù)資料
| 型號： | L64364 |
| 廠商： | LSI Corporation |
| 英文描述： | Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片) |
| 中文描述： | 高度集成的自動柜員機分段和重組（SAR）的網(wǎng)絡(luò)應(yīng)用（用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片優(yōu)化引擎） |
| 文件頁數(shù)： | 180/444頁 |
| 文件大小： | 3267K |
| 代理商： | L64364 |
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5-6
Enhanced DMA
CS-PDU payloads are queued for segmentation on a given virtual
connection by attaching the corresponding Buffer Descriptors to the tail
of the buffer list. The EDMA’s Buff Processor performs this operation
when it receives a
buff
command from the APU. When buffer data
segmentation is completed, the TxCell Processor places the Buffer
Number in the EDMA Transmit Completion Queue and removes it from
the buffer list by advancing the list head pointer.
The RxCell Processor reassembles CS-PDU payloads in buffers. When
the APU instructs the RxCell Processor to reassemble a cell belonging
to a virtual connection, the processor checks if there is enough space in
the buffer to store the cell payload. If there is not enough space, the
processor returns the current buffer to the Receive Completion Queue
and attempts to use a buffer following the current one on the linked list.
In case there is no buffer following the current one, the RxCell Processor
attaches a buffer from one of the six Small or Large Free Buffer Lists to
the VC Descriptor. The free buffer list used is defined by the
VCD_RxCtrl
bits in the
VCD Control
field of the VCD. The VCD structure is described
in the next section.
If the APU wants to control the memory management, it can provide
buffer numbers for the RxCell Processor in advance. The EDMA always
attempts to use existing buffers before linking a new one from a Free
Buffer List. This arrangement supports both elaborated buffer
management using the APU and a simple, but fast, EDMA (hardware)
controlled scheme.
5.2.1 VC Descriptor Structure
As shown in
Figure 5.3
, the structure of a VC Descriptor differs slightly
between the transmit and receive directions. For both transmit and
receive, the descriptor occupies eight words and must be aligned on a
32-byte boundary.
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