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參數(shù)資料
| 型號(hào)： | KM4232W259A |
| 廠商： | SAMSUNG SEMICONDUCTOR CO. LTD. |
| 英文描述： | CMOS Window RAM（1M Byte Dual Ported DRAM Array）(CMOS視窗RAM（1M字節(jié)的雙口動(dòng)態(tài)RAM陣列）) |
| 中文描述： | 窗口的CMOS內(nèi)存（1M字節(jié)雙端口內(nèi)存陣列）（視窗的CMOS存儲(chǔ)器（100萬(wàn)字節(jié)的雙口動(dòng)態(tài)內(nèi)存陣列）） |
| 文件頁(yè)數(shù)： | 5/46頁(yè) |
| 文件大?。?/td> | 836K |
| 代理商： | KM4232W259A |
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KM4232W259A
CMOS WINDOW RAM
Rev.0 (August 1997)
RAS CONTROL CYCLES TRUTH TABLE
Notes :
1. OE = 1 updates MASK Register content. OE = 0 uses previously loaded Mask data.
2. = Byte Control(refer to Byte Enable Truth Table).
CAS #2
RAS #1
Mnemonic
Code
Function
BE
3
-
0
X
X
CAS
0
0
OE
X
X
0/1
DSF2
X
X
DSF1
X
X
DSF0
0
1
RA
8
-
0
X
X
W
31
-
0
X
X
WPB
Mask
RST
CBR
Reset Cycle
CBR Refresh
(Note 2)
1
(Note 1)
X
X
0
ROW
RW/ROR
New ROW initiation for any RW
cycle, RAS only Refresh
X
1
0/1
(Note 1)
X
X
1
X
WPB
Mask
Vendor Specific mode
BYTE ENABLE TRUTH TABLE
CAS #2
OPERATION
BE
0
0
1
Byte Read/Write Enable(DQ
0
~ DQ
7
)
Byte Read/Write Disable(DQ
0
~ DQ
7
)
BE
1
0
1
Byte Read/Write Enable(DQ
8
~ DQ
15
)
Byte Read/Write Disable(DQ
8
~ DQ
15
)
BE
2
0
1
Byte Read/Write Enable(DQ
16
~ DQ
23
)
Byte Read/Write Disable(DQ
16
~ DQ
23
)
BE
3
0
1
Byte Read/Write Enable(DQ
24
~ DQ
31
)
Byte Read/Write Disable(DQ
24
~ DQ
31
)
RESET CYCLE
AFTER RESET CYCLE
Color Register 0, 1
Mask Register
SAM Transfer Counter
Reset to "0"
Reset to "1" : non-masking mode
Reset to "0" : Address the first Row of SAM(first SAM)
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