參數(shù)資料
型號(hào)： IDT82P2288BBG8
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 12/362頁(yè)
文件大小： 0K
描述： TXRX T1/J1/E1 8CHAN 256-PBGA
標(biāo)準(zhǔn)包裝： 1,000
類(lèi)型： 收發(fā)器
規(guī)程： IEEE 1149.1
電源電壓： 3 V ~ 3.6 V
安裝類(lèi)型： 表面貼裝
封裝/外殼： 256-BBGA
供應(yīng)商設(shè)備封裝： 256-PBGA（17x17）
包裝： 帶卷 (TR)
其它名稱： 82P2288BBG8
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IDT82P2288
OCTAL T1/E1/J1 LONG HAUL / SHORT HAUL TRANSCEIVER
Functional Description
109
March 04, 2009
3.25 LINE DRIVER
The Line Driver can be set to High-Z for redundant application.
The following ways will set the drivers to High-Z:
- Setting the THZ pin to high will globally set all the Line Drivers to
High-Z;
- When there is no clock input on the OSCI pin, all the Line Drivers
will be High-Z (no clock means this: the input on the OSCI pin is
in high/low level, or the duty cycle is less than 30% or larger than
70%);
- After software reset, hardware reset or power on, all the Line
Drivers will be High-Z;
- Setting the T_HZ bit to ‘1’ will set the corresponding Line Driver
to High-Z;
- In Transmit Clock Master mode, if the XTS bit is ‘1’, the source of
the transmit clock is from the recovered clock from the line side.
When the recovered clock from the line side is lost, the Line
Driver in the corresponding link will be High-Z;
- In Transmit Clock Slave mode, if the XTS bit is ‘0’, the source of
the transmit clock is from the backplane timing clock. When the
backplane timing clock is lost (i.e., no transition for more than 72
T1/E1/J1 cycles), the Line Driver in the corresponding link will be
High-Z. However, there is an exception in this case. That is, if the
link is in Remote Loopback mode, the Line Driver will not be
High-Z.
- When the transmit path is power down, the Line Driver in the cor-
responding link will be High-Z.
By these ways, the TTIPn and TRINGn pins will enter into high
impedance state immediately.
Controlled by the DFM_ON bit, the output driver short-circuit protec-
tion can be enabled. The driver’s output current (peak to peak) is limited
to 110 mA typically. When the output current exceeds the limitation, the
transmit driver failure will be captured by the DF_S bit. Selected by the
DF_IES bit, a transition from ‘0’ to ‘1’ on the DF_S bit or any transition
from ‘0’ to ‘1’ or from ‘1’ to ‘0’ on the DF_S bit will set the DF_IS bit.
When the DF_IS bit is ‘1’, an interrupt on the INT pin will be reported if
enabled by the DF_IE bit.
3.26 TRANSMITTER IMPEDANCE MATCHING
In T1/J1 mode, the transmitter impedance matching can be realized
by using internal impedance matching circuit. 100
, 110 , 75 or
120
internal impedance matching circuit can be selected by the
T_TERM[1:0] bits. The external impedance circuitry is not supported in
T1/J1 mode.
In E1 mode, the transmitter impedance matching can be realized by
using internal impedance matching circuit or external impedance
matching circuit. When the T_TERM[2] bit is ‘0’, the internal impedance
matching circuit is enabled. 100
, 110 , 75 or 120 internal
impedance matching circuit can be selected by the T_TERM[1:0] bits.
When the T_TERM[2] bit is ‘1’, the internal impedance matching circuit
is disabled, and different external resistors should be used to realize
different impedance matching.
Figure 2 shows the appropriate components to connect with the
cable for one link. Table 75 lists the recommended impedance matching
values for the transmitter.
3.27 TESTING AND DIAGNOSTIC FACILITIES
3.27.1 PRBS GENERATOR / DETECTOR
The PRBS Generator / Detector generates test pattern to either the
transmit or receive direction, and detects the pattern in the opposite
direction. The direction is determined by the PRBSDIR bit. The pattern
can be generated or detected in unframed mode, in 8-bit-based mode or
in 7-bit-based mode. This selection is made by the PRBSMODE[1:0]
bits. In unframed mode, all the data streams are extracted or replaced
and the per-channel/per-TS configuration in the TEST bit is ignored. In
8-bit-based mode or in 7-bit-based mode, the extracted or replaced
channel/timeslot is specified by the TEST bit. (In 7-bit-based mode, only
the higher 7 bits of the selected channel/timeslot are used for PRBS
test).
Table 75: Impedance Matching Value For The Transmitter
Cable
Configuration
Internal Termination
External Termination
T_TERM[2:0]
RT
T_TERM[2:0]
RT
75
(E1)
0 0 0
0
1 X X
9.4
120
(E1)
100
(T1)
0 1 0
-
110
(J1)
0 1 1
-
Table 76: Related Bit / Register In Chapter 3.25 & Chapter 3.26
Bit
Register
Address (Hex)
T_HZ
Transmit Configuration 1
023, 123, 223, 323,
423, 523, 623, 723
DFM_ON
XTS
Transmit Timing Option
070, 170, 270, 370,
470, 570, 670, 770
DF_S
Line Status Register 0
036, 136, 236, 336,
436, 536, 636, 736
DF_IES
Interrupt Trigger Edges Select
035, 135, 235, 335,
435, 535, 635, 735
DF_IS
Interrupt Status 0
03A, 13A, 23A, 33A,
43A, 53A, 63A, 73A
DF_IE
Interrupt Enable Control 0
033, 133, 233, 333,
433, 533, 633, 733
T_TERM[2:0]
Transmit And Receive Termi-
nation Configuration
032, 132, 232, 332,
432, 532, 632, 732
相關(guān)PDF資料
PDF描述
V48B15M250BF2 CONVERTER MOD DC/DC 15V 250W
IDT72615L50PF IC FIFO BY SYNC 512X18X2 64QFP
IDT82P2288BB8 TXRX T1/J1/E1 8CHAN 256-PBGA
V48B15M250BF CONVERTER MOD DC/DC 15V 250W
IDT723643L15PF IC FIFO SYNC 1024X36 128QFP
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
IDT82P2521 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:21(1) Channel High-Density E1 Line Interface Unit
IDT82P2521BH 功能描述:IC LIU E1 21+1CH SHORT 640-PBGA RoHS:否 類(lèi)別:集成電路 (IC) >> 接口 - 驅(qū)動(dòng)器，接收器，收發(fā)器 系列:- 標(biāo)準(zhǔn)包裝:250 系列:- 類(lèi)型:收發(fā)器 驅(qū)動(dòng)器/接收器數(shù):2/2 規(guī)程:RS232 電源電壓:3 V ~ 5.5 V 安裝類(lèi)型:表面貼裝 封裝/外殼:16-TSSOP（0.173"，4.40mm 寬） 供應(yīng)商設(shè)備封裝:16-TSSOP 包裝:帶卷 (TR)
IDT82P2521BHBLANK 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:21(1) Channel High-Density E1 Line Interface Unit
IDT82P2521BHG 功能描述:IC LIU E1 21+1CH SHORT 640-PBGA RoHS:是 類(lèi)別:集成電路 (IC) >> 接口 - 驅(qū)動(dòng)器，接收器，收發(fā)器 系列:- 標(biāo)準(zhǔn)包裝:250 系列:- 類(lèi)型:收發(fā)器 驅(qū)動(dòng)器/接收器數(shù):2/2 規(guī)程:RS232 電源電壓:3 V ~ 5.5 V 安裝類(lèi)型:表面貼裝 封裝/外殼:16-TSSOP（0.173"，4.40mm 寬） 供應(yīng)商設(shè)備封裝:16-TSSOP 包裝:帶卷 (TR)
IDT82P2521BHGBLANK 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:21(1) Channel High-Density E1 Line Interface Unit
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