參數(shù)資料
型號(hào)： IDT70T3319S166BC
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類(lèi)： DRAM
英文描述： JFET-Input Operational Amplifier 8-PDIP 0 to 70
中文描述： 256K X 18 DUAL-PORT SRAM, 12 ns, PBGA256
封裝： 17 X 17 MM, 1.40 MM HEIGHT, 1 MM PITCH, BGA-256
文件頁(yè)數(shù)： 25/28頁(yè)
文件大小： 485K
代理商： IDT70T3319S166BC
6.42
IDT70T3339/19/99S
High-Speed 2.5V 512/256/128K x 18 Dual-Port Static RAM Industrial and Commercial Temperature Ranges
PRELIMINARY
JTAG AC Electrical
Characteristics
(1,2,3,4)
JTAG Timing Specifications
NOTES:
1. Guaranteed by design.
2. 30pF loading on external output signals.
3. Refer to AC Electrical Test Conditions stated earlier in this document.
4. JTAG operations occur at one speed (10MHz). The base device may run at
any speed specified in this datasheet.
TCK
Device Inputs
(1)
/
TDI/TMS
Device Outputs
(2)
/
TDO
TRST
t
JCD
t
JDC
t
JRST
t
JS
t
JH
t
JCYC
t
JRSR
t
JF
t
JCL
t
JR
t
JCH
5652 drw 23
,
NOTES:
1. Device inputs = All device inputs except TDI, TMS, and TRST.
2. Device outputs = All device outputs except TDO.
70T3339/19/99
Symbol
Parameter
Mn.
Max.
Units
t
JCYC
JTAG Clock Input Period
100
____
ns
t
JCH
JTAG Clock HIGH
40
____
ns
t
JCL
JTAG Clock Low
40
____
ns
t
JR
JTAG Clock Rise Time
____
3
(1)
ns
t
JF
JTAG Clock Fall Time
____
3
(1)
ns
t
JRST
JTAG Reset
50
____
ns
t
JRSR
JTAG Reset Recovery
50
____
ns
t
JCD
JTAG Data Output
____
25
ns
t
JDC
JTAG Data Output Hold
0
____
ns
t
JS
JTAG Setup
15
____
ns
t
JH
JTAG Hold
15
____
ns
5652 tbl 15
相關(guān)PDF資料
PDF描述
IDT70T3339S133BC HIGH-SPEED 2.5V 512/256/128K X 18 SYNCHRONOUS DUAL-PORT STATIC RAM WITH 3.3V OR 2.5V INTERFACE
IDT70T3339S166BC JFET-Input Operational Amplifier 8-SOIC -40 to 85
IDT70T3319S133BC HIGH-SPEED 2.5V 512/256/128K X 18 SYNCHRONOUS DUAL-PORT STATIC RAM WITH 3.3V OR 2.5V INTERFACE
IDT70T3339S200BC HIGH-SPEED 2.5V 512/256/128K X 18 SYNCHRONOUS DUAL-PORT STATIC RAM WITH 3.3V OR 2.5V INTERFACE
IDT70T3319S200BC HIGH-SPEED 2.5V 512/256/128K X 18 SYNCHRONOUS DUAL-PORT STATIC RAM WITH 3.3V OR 2.5V INTERFACE
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參數(shù)描述
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