參數(shù)資料
型號(hào)： ICS813078BYILFT
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 10/26頁
文件大?。?/td> 0K
描述： IC VCXO PLL WIRELESS 64TQFP
標(biāo)準(zhǔn)包裝： 500
系列： HiPerClockS™, FemtoClock™
類型： 時(shí)鐘/頻率發(fā)生器，扇出緩沖器（分配），抖動(dòng)衰減器，多路復(fù)用器
PLL： 是
主要目的： 無線基礎(chǔ)架構(gòu)應(yīng)用
輸入： LVDS，LVHSTL，LVPECL，晶體
輸出： LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 3:9
差分 - 輸入:輸出： 是/是
頻率 - 最大： 614.4MHz
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 64-TQFP 裸露焊盤
供應(yīng)商設(shè)備封裝： 64-TQFP-EP（10x10）
包裝： 帶卷 (TR)
ICS813078I
FEMTOCLOCKS VCXO-PLL FREQUENCY GENERATOR
FEMTOCLOCKS VCXO-PLL FREQUENCY GENERATOR
18
ICS813078BYI REV. A OCTOBER 6, 2008
Differential Clock Input Interface
The CLK /nCLK accepts LVDS, LVPECL, LVHSTL, SSTL, HCSL
and other differential signals. Both VSWING and VOH must meet the
VPP and VCMR input requirements. Figures 4A to 4F show interface
examples for the HiPerClockS CLK/nCLK input driven by the most
common driver types. The input interfaces suggested here are
examples only. Please consult with the vendor of the driver
component to confirm the driver termination requirements. For
example, in Figure 4A, the input termination applies for IDT
HiPerClockS open emitter LVHSTL drivers. If you are using an
LVHSTL driver from another vendor, use their termination
recommendation.
Figure 4A. HiPerClockS CLK/nCLK Input
Driven by an IDT Open Emitter
HiPerClockS LVHSTL Driver
Figure 4C. HiPerClockS CLK/nCLK Input
Driven by a 3.3V LVPECL Driver
Figure 4E. HiPerClockS CLK/nCLK Input
Driven by a 3.3V HCSL Driver
Figure 4B. HiPerClockS CLK/nCLK Input
Driven by a 3.3V LVPECL Driver
Figure 4D. HiPerClockS CLK/nCLK Input
Driven by a 3.3V LVDS Driver
Figure 4F. HiPerClockS CLK/nCLK Input
Driven by a 2.5V SSTL Driver
R1
50
R2
50
1.8V
Zo = 50
Zo = 50
CLK
nCLK
3.3V
LVHSTL
IDT
HiPerClockS
LVHSTL Driver
HiPerClockS
Input
R3
125
R4
125
R1
84
R2
84
3.3V
Zo = 50
Zo = 50
CLK
nCLK
3.3V
LVPECL
HiPerClockS
Input
HCSL
*R3
33
*R4
33
CLK
nCLK
2.5V
3.3V
Zo = 50
Zo = 50
HiPerClockS
Input
R1
50
R2
50
*Optional – R3 and R4 can be 0
CLK
nCLK
HiPerClockS
Input
LVPECL
3.3V
Zo = 50
Zo = 50
3.3V
R1
50
R2
50
R2
50
3.3V
R1
100
LVDS
CLK
nCLK
3.3V
Receiver
Zo = 50
Zo = 50
CLK
nCLK
HiPerClockS
SSTL
2.5V
Zo = 60
Zo = 60
2.5V
3.3V
R1
120
R2
120
R3
120
R4
120
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PDF描述
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