參數(shù)資料
型號(hào): EVAL-CN0204-SDPZ
廠商: Analog Devices Inc
文件頁數(shù): 6/32頁
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描述: BOARD CFTL AD5662 AD5751
設(shè)計(jì)資源: CN-0204 CFTL Eval/Design Support
標(biāo)準(zhǔn)包裝: 1
系列: Circuits from the Lab™
主要目的: 參考設(shè)計(jì),模擬輸出模塊
嵌入式:
已用 IC / 零件: AD5662,AD5751,ADuM1301,ADuM5401
主要屬性: 隔離
已供物品:
AD5751
Data Sheet
Rev. B | Page 14 of 32
12
10
8
6
4
2
0
27
22
17
12
7
2
–3
–8
VO
L
T
A
G
E
(V)
TIME (s)
07269-
026
Figure 17. Full-Scale Negative Step, 10 V Range
40
35
30
25
20
15
10
5
0
–5
2.5
2.0
1.5
1.0
0.5
0
–0.5
–1.0
V
O
UT
(m
V)
TIME (ms)
07269-
027
Figure 18. VOUT vs. Time on Power-Up, Load = 2 k || 200 pF
CH1 5.00V
CH2 20.0mV BW M1.0s
A CH1
3.00V
1
2
07269-
028
Figure 19. VOUT Enable Glitch, Load = 2 k || 1 nF
5V/DIV
1s/DIV
07269-
029
Figure 20. Peak-to-Peak Noise (0.1 Hz to 10 Hz Bandwidth)
100V/DIV
1s/DIV
07269-
030
Figure 21. Peak-to-Peak Noise (100 kHz Bandwidth)
4.0
3.5
3.0
2.5
2.0
1.5
1.0
0.5
0
1.0
0.8
0.6
0.4
0.2
0
–0.2
2.0
1.5
VDD
VOUT
1.0
0.5
0
–0.5
–1.0
–1.5
V
DD
(V)
V
O
UT
(V)
TIME (ms)
07269-
031
Figure 22. VDD and VOUT vs. Time on Power-Up
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