t
參數(shù)資料
型號(hào)： EVAL-ADUC831QSZ
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 66/76頁(yè)
文件大小： 0K
描述： KIT DEV FOR ADUC831 QUICK START
產(chǎn)品培訓(xùn)模塊： Process Control
標(biāo)準(zhǔn)包裝： 1
系列： QuickStart™ 套件
類型： MCU
適用于相關(guān)產(chǎn)品： ADuC831
所含物品： 評(píng)估板、電源、纜線、軟件和說(shuō)明文檔
產(chǎn)品目錄頁(yè)面： 739 (CN2011-ZH PDF)
相關(guān)產(chǎn)品： ADUC831BCPZ-ND - IC MCU 62K FLASH ADC/DAC 56LFCSP
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ADUC831BSZ-ND - IC ADC/DAC 12BIT W/MCU 52-MQFP
其它名稱： EVAL-ADUC831QS
EVAL-ADUC831QS-ND
REV. 0
ADuC831
–69–
12 MHz
Variable Clock
Parameter
Min
Max
Min
Max
Unit
Figure
EXTERNAL DATA MEMORY WRITE CYCLE
tWLWH
WR Pulsewidth
400
6tCK – 100
ns
72
tAVLL
Address Valid after ALE Low
43
tCK –40
ns
72
tLLAX
Address Hold after ALE Low
48
tCK –35
ns
72
tLLWL
ALE Low to
RD or WR Low
200
300
3tCK –50
3tCK +50
ns
72
tAVWL
Address Valid to
RD or WR Low
203
4tCK – 130
ns
72
tQVWX
Data Valid to
WR Transition
33
tCK –50
ns
72
tQVWH
Data Setup before
WR
433
7tCK – 150
ns
72
tWHQX
Data and Address Hold after
WR
33
tCK –50
ns
72
tWHLH
RD or WR High to ALE High
43
123
tCK –40
6tCK – 100
ns
72
t
LLAX
DATA
MCLK
ALE (O)
PSEN (O)
PORT 2 (O)
t
LLWL
t
AVWL
t
AVLL
t
QVWX
t
WHQX
t
WHLH
A0–A7
A16–A23
A8–A15
t
WLWH
t
QVWH
WR (O)
Figure 72. External Data Memory Write Cycle
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