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參數(shù)資料
| 型號： | EPM7032B |
| 廠商： | Altera Corporation |
| 英文描述： | Programmable Logic Device Family(MAX7000B可編程邏輯系列器件) |
| 中文描述： | 可編程邏輯器件系列（MAX7000B可編程邏輯系列器件） |
| 文件頁數(shù)： | 12/125頁 |
| 文件大?。?/td> | 1053K |
| 代理商： | EPM7032B |
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Altera Corporation
MAX 7000B Programmable Logic Device Family Data Sheet
Preliminary Information
Figure 5. MAX 7000B PIA Routing
While the routing delays of channel-based routing schemes in masked or
field-programmable gate arrays (FPGAs) are cumulative, variable, and
path-dependent, the MAX 7000B PIA has a predictable delay. The PIA
makes a design’s timing performance easy to predict.
I/O Control Blocks
The I/ O control block allows each I/ O pin to be individually configured
for input, output, or bidirectional operation. All I/ O pins have a tri-state
buffer that is individually controlled by one of the global output enable
signals or directly connected to ground or V
CC
.
Figure 6
shows the I/ O
control block for MAX 7000B devices. The I/ O control block has
six or ten global output enable signals that are driven by the true or
complement of two output enable signals, a subset of the I/ O pins, or a
subset of the I/ O macrocells.
To LAB
PIA Signals
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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