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參數資料
| 型號： | EP1S80F1508I7ES |
| 廠商： | Altera Corporation |
| 英文描述： | Stratix Device Family Data Sheet |
| 中文描述： | Stratix系列器件數據手冊 |
| 文件頁數： | 30/290頁 |
| 文件大?。?/td> | 3559K |
| 代理商： | EP1S80F1508I7ES |
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2–6
Stratix Device Handbook, Volume 1
Altera Corporation
July 2005
Logic Elements
With the LAB-wide
addnsub
control signal, a single LE can implement a
one-bit adder and subtractor. This saves LE resources and improves
performance for logic functions such as DSP correlators and signed
multipliers that alternate between addition and subtraction depending
on data.
The LAB row clocks [7..0] and LAB local interconnect generate the LAB-
wide control signals. The MultiTrack
TM
interconnect’s inherent low skew
allows clock and control signal distribution in addition to data.
Figure 2–4
shows the LAB control signal generation circuit.
Figure 2–4. LAB-Wide Control Signals
Logic Elements
The smallest unit of logic in the Stratix architecture, the LE, is compact
and provides advanced features with efficient logic utilization. Each LE
contains a four-input LUT, which is a function generator that can
implement any function of four variables. In addition, each LE contains a
programmable register and carry chain with carry select capability. A
single LE also supports dynamic single bit addition or subtraction mode
selectable by an LAB-wide control signal. Each LE drives all types of
interconnects: local, row, column, LUT chain, register chain, and direct
link interconnects. See
Figure 2–5
.
labclkena1
labclk2
labclk1
labclkena2
asyncload
or labpre
syncload
Dedicated
Row LAB
Clocks
Local
Interconnect
Local
Interconnect
Local
Interconnect
Local
Interconnect
Local
Interconnect
Local
Interconnect
labclr1
labclr2
synclr
addnsub
8
相關PDF資料 |
PDF描述 |
|---|---|
| EP1S25F1508I7ES | Stratix Device Family Data Sheet |
| EP1S30F1508I7ES | Stratix Device Family Data Sheet |
| EP1S40F1508I7ES | Stratix Device Family Data Sheet |
| EP1S80B956 | Stratix Device Family Data Sheet |
| EP1S20B1508C5ES | Stratix Device Family Data Sheet |
相關代理商/技術參數 |
參數描述 |
|---|---|
| EP1S80F1508I7N | 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix I 7904 LABs 1203 IO RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP1S-B3G1 | 制造商:NEC 制造商全稱:NEC 功能描述:AUTOMOTIVE RELAYS LOW SOUND PRESSURE |
| EP1S-B3G1T | 制造商:NEC 制造商全稱:NEC 功能描述:LOW SOUND PRESSURE |
| EP1S-B3G1TT | 制造商:NEC 制造商全稱:NEC 功能描述:LOW SOUND PRESSURE |
| EP1S-B3G2 | 制造商:NEC 制造商全稱:NEC 功能描述:LOW SOUND PRESSURE |
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