參數(shù)資料
型號： EP1S80F1508I7ES
廠商： Altera Corporation
英文描述： Stratix Device Family Data Sheet
中文描述： Stratix系列器件數(shù)據(jù)手冊
文件頁數(shù)： 118/290頁
文件大?。?/td> 3559K
代理商： EP1S80F1508I7ES
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2–94
Stratix Device Handbook, Volume 1
Altera Corporation
July 2005
PLLs & Clock Networks
Any of the four external output counters can drive the single-ended or
differential clock outputs for PLLs 5 and 6. This means one counter or
frequency can drive all output pins available from PLL 5 or PLL 6. Each
pair of output pins (four pins total) has dedicated
VCC
and
GND
pins to
reduce the output clock’s overall jitter by providing improved isolation
from switching I/O pins.
For PLLs 5 and 6, each pin of a single-ended output pair can either be in
phase or 180° out of phase. The clock output pin pairs support the same
I/O standards as standard output pins (in the top and bottom banks) as
well as LVDS, LVPECL, 3.3-V PCML, HyperTransport technology,
differential HSTL, and differential SSTL.
Table 2–20
shows which I/O
standards the enhanced PLL clock pins support. When in single-ended or
differential mode, the two outputs operate off the same power supply.
Both outputs use the same standards in single-ended mode to maintain
performance. You can also use the external clock output pins as user
output pins if external enhanced PLL clocking is not needed.
Table 2–20. I/O Standards Supported for Enhanced PLL Pins (Part 1 of 2)
I/O Standard
Input
Output
INCLK
v
v
v
v
v
v
v
v
v
v
v
v
FBIN
v
v
v
v
v
v
v
v
v
v
v
PLLENABLE
v
v
EXTCLK
v
v
v
v
v
v
v
v
v
v
v
v
v
v
v
v
LVTTL
LVCMOS
2.5 V
1.8 V
1.5 V
3.3-V PCI
3.3-V PCI-X 1.0
LVPECL
3.3-V PCML
LVDS
HyperTransport technology
Differential HSTL
Differential SSTL
3.3-V GTL
v
v
v
v
v
v
3.3-V GTL+
1.5-V HSTL Class I
相關PDF資料
PDF描述
EP1S25F1508I7ES Stratix Device Family Data Sheet
EP1S30F1508I7ES Stratix Device Family Data Sheet
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EP1S80B956 Stratix Device Family Data Sheet
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參數(shù)描述
EP1S80F1508I7N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I 7904 LABs 1203 IO RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP1S-B3G1 制造商:NEC 制造商全稱:NEC 功能描述:AUTOMOTIVE RELAYS LOW SOUND PRESSURE
EP1S-B3G1T 制造商:NEC 制造商全稱:NEC 功能描述:LOW SOUND PRESSURE
EP1S-B3G1TT 制造商:NEC 制造商全稱:NEC 功能描述:LOW SOUND PRESSURE
EP1S-B3G2 制造商:NEC 制造商全稱:NEC 功能描述:LOW SOUND PRESSURE
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