參數(shù)資料
型號： DSP96002UM
英文描述： DSP96002 32-Bit Floating-Point Dual-Port DSP User＇s Manual
中文描述： DSP96002 32位浮點雙端口的DSP用戶手冊
文件頁數(shù)： 191/897頁
文件大?。?/td> 3495K
代理商： DSP96002UM
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MOTOROLA
DSP96002 USER’S MANUAL
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A - 3
by Address Generation Unit operation when executing MOVETA instructions. Cleared
otherwise. The V bit is cleared during processor reset.
Z(Zero)
Set if the result equals zero. The Z bit is also set for floating-point -zero as well as +zero.
The zero bit is also modified by Address Generation Unit operation when executing
MOVETA instructions. Cleared otherwise. The Z bit is cleared during processor reset.
N(Negative)
Set if the MSB of the result is set for integer operations or if the sign bit of the result is
set for floating-point operations. The negative bit is also modified by Address Genera-
tion Unit operation when executing MOVETA instructions. Cleared otherwise. The N
bit is cleared during processor reset.
I(Infinity)
Set if the result of a floating-point operation is a signed infinity. Cleared otherwise. The
I bit is not affected by fixed point operations but is affected by some conversion instruc-
tions. For example, if D is infinity, then executing FABS.S D will set the I bit. The I bit is
cleared during processor reset.
LR(Local Reject) The LR bit is only affected by the compare instructions CMP, CMPG, FCMP and FC-
MPG. The LR bit is cleared during processor reset. See the example for the FCMPG
instruction for additional information.
–R(Reject)
The –R bit is only affected by the compare instructions CMP, CMPG, FCMP and FC-
MPG. The –R bit is calculated based on its previous value and the results of the current
Modifier
MMMMMMMM
0 0 0 0 0 0 0 0
0 0 0 0 0 0 0 1
0 0 0 0 0 0 0 2
Address Calculation Arithmetic
Reverse Carry
(Bit Reversed Update)
Modulo 2
Modulo 3
.
.
.
.
.
.
.
.
.
0 0 F F F F F E
0 0 F F F F F F
0 1 x x x x x
0 2 x x x x x
Modulo 16,777,215
Modulo 16,777,216
reserved
reserved
((2**24)-1)
(2**24)
x
x
.
.
.
.
.
.
.
.
.
F D x x x x x
F E x x x x x
F F 0 0 0 0 0 0
F F 0 0 0 0 0 1
F F 0 0 0 0 0 3
F F 0 0 0 0 0 7
F F 3 F F F F F
F F 7 F F F F F
F F F F F F F F
x
x
reserved
reserved
reserved
Multiple Wrap-Around Modulo 2
Multiple Wrap-Around Modulo 4
Multiple Wrap-Around Modulo 8
Multiple Wrap-Around Modulo 2**22
Multiple Wrap-Around Modulo 2**23
Linear (Modulo 2**32)
where MMMMMMMM = Modifier Register Contents in Hex
Figure A-2. Address Modifier Summary
F
Freescale Semiconductor, Inc.
n
.
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PDF描述
DSPASMRM DSP Assembler Reference Manual
DSPB56007FJ50 DSP|24-BIT|CMOS|QFP|80PIN|PLASTIC
DSPB56007FJ66 DSP|24-BIT|CMOS|QFP|80PIN|PLASTIC
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DSPE56007FJ50 DSP|24-BIT|CMOS|QFP|80PIN|PLASTIC
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