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參數(shù)資料
| 型號： | DS3134 |
| 廠商： | DALLAS SEMICONDUCTOR |
| 元件分類： | Digital Transmission Controller |
| 英文描述： | DATACOM, FRAMER, PBGA256 |
| 封裝： | 27 X 27 MM, PLASTIC, BGA-256 |
| 文件頁數(shù)： | 34/203頁 |
| 文件大小： | 777K |
| 代理商： | DS3134 |
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DS3134
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8.2.2 Packet Descriptors
In main memory resides a contiguous section up to 65,536 quad dwords that make up the Transmit Packet
Descriptors. The Transmit Packet Descriptors are aligned on a quad dword basis and can be placed
anywhere in the 32-bit address space via the Transmit Descriptor Base Address (see Table 8.2.2A).
Associated with each descriptor is a data buffer. The data buffer can be up to 8191 bytes long and must
be a contiguous section of main memory. The host will inform the DMA of the actual size of the data
buffer via the Byte Count field that resides in the Packet Descriptor. If an outgoing packet requires more
space than the data buffer allows, then Packet Descriptors will be link-listed together by the Host to
provide a chain of data buffers. Figure 8.2.2A is an example of how three descriptors were linked
together for an incoming packet on HDLC Channel 7. Channel 3 only required a single data buffer and
hence only one Packet Descriptor was used. Figure 8.2.1A shows a similar example for channels5 and 1.
Packet Descriptors can be either pending (i.e. queued up by the host and ready for transmission by the
DMA) or completed (i.e. have been transmitted by the DMA and are available for processing by the host).
Pending Packet Descriptors are pointed to by the Pending Queue Descriptors and completed Packet
Descriptors are pointed to by the Done Queue Descriptors.
Transmit Descriptor Address Storage Table 8.2.2A
Register Name
Acronym
Address
Transmit Descriptor Base Address 0 (lower word)
TDBA0
0850h
Transmit Descriptor Base Address 1 (upper word)
TDBA1
0854h
Transmit Descriptor Example Figure 8.2.2A
dmatde
CH 5 Single Sent Buffer Descriptor
Base + 00h
CH 7 1st Queued Buffer Descriptor
Base + 10h
Base + 20h
CH 7 Sent 1st Buffer Descriptor
Base + 30h
Free Descriptor
Base + 40h
Base + 50h
Free Descriptor
Base + 60h
Base + 70h
CH 7 Last Sent Buffer Descriptor
Base + 80h
Free Descriptor
Base + FFFD0h
Free Descriptor
Base + FFFF0h
CH 3 Single Queued Buffer Desc.
CH 7 2nd Queued Buffer Descriptor
CH 7 Last Queued Buffer Descriptor
Pending Queue Descriptor Address
Done Queue Descriptor Pointer
Maximum of 65536
Descriptors
相關PDF資料 |
PDF描述 |
|---|---|
| DS3150QN | DATACOM, PCM TRANSCEIVER, PQCC28 |
| DS3150Q | DATACOM, PCM TRANSCEIVER, PQCC28 |
| DS3150TN | DATACOM, PCM TRANSCEIVER, PDIP48 |
| DS3150T | DATACOM, PCM TRANSCEIVER, PQFP48 |
| DS5000FP-12 | 8-BIT, 12 MHz, MICROCONTROLLER, PQFP80 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| DS-313PIN | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Analog Miscellaneous |
| DS-313-PIN | 功能描述:信號調節(jié) RoHS:否 制造商:EPCOS 產品:Duplexers 頻率:782 MHz, 751 MHz 頻率范圍: 電壓額定值: 帶寬: 阻抗:50 Ohms 端接類型:SMD/SMT 封裝 / 箱體:2.5 mm x 2 mm 工作溫度范圍:- 30 C to + 85 C 封裝:Reel |
| DS31400 | 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:8-Input, 14-Output, Dual DPLL Timing IC with Sub-ps Output Jitter |
| DS31400DK | 功能描述:時鐘和定時器開發(fā)工具 DS31400 Dev Kit RoHS:否 制造商:Texas Instruments 產品:Evaluation Modules 類型:Clock Conditioners 工具用于評估:LMK04100B 頻率:122.8 MHz 工作電源電壓:3.3 V |
| DS31400GN | 功能描述:計時器和支持產品 Not Available From Mouser RoHS:否 制造商:Micrel 類型:Standard 封裝 / 箱體:SOT-23 內部定時器數(shù)量:1 電源電壓-最大:18 V 電源電壓-最小:2.7 V 最大功率耗散: 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝:Reel |
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