參數(shù)資料
型號(hào)： DS26303L-75
廠商： MAXIM INTEGRATED PRODUCTS INC
元件分類(lèi)： 數(shù)字傳輸電路
英文描述： 3.3V, E1/T1/J1, Short-Haul, Octal Line Interface Unit
中文描述： DATACOM, PCM TRANSCEIVER, PQFP144
封裝： 20 X 20 MM, 1.40 MM HEIGHT, MS-026, LQFP-144
文件頁(yè)數(shù)： 45/97頁(yè)
文件大小： 966K
代理商： DS26303L-75
DS26303: 3.3V, T1/E1/J1, Short-Haul, Octal Line Interface Unit
45 of 97
Register Name:
Register Description:
Register Address:
Bit #
Name
Default
Bits 7 to 0: RCLK Disable Upon LOS Register
n
(RDULR
n
).
When this bit is set the RCLK for channel
n
is
disabled upon a loss of signal and set as a low output. When reset or default, RCLK switches to MCLK upon a loss
of signal within 10ms.
RDULR
RCLK Disable Upon LOS Register
16h
7
6
5
4
3
2
1
0
RDULR8
0
RDULR7
0
RDULR6
0
RDULR5
0
RDULR4
0
RDULR3
0
RDULR2
0
RDULR1
0
Register Name:
Register Description:
Register Address:
Bit #
Name
Default
Bit 1: INT Pin Mode (INTM).
This bit determines the inactive mode of the
INT
pin. The
INT
pin always drives low
when active.
0 = Pin is high impedance when not active.
1 = Pin drives high when not active.
Bit 0: Clear-On-Write Enable (CWE).
When this bit is set, the clear-on-write is enabled for all the latched interrupt
status registers. The host processor must write a 1 to the latched interrupt status register bit position before the
particular bit is cleared. Default for all the latched interrupt status registers is to clear on a read.
GISC
Global Interrupt Status Control
1Eh
7
—
0
6
—
0
5
—
0
4
—
0
3
—
0
2
—
0
1
0
INTM
0
CWE
0
相關(guān)PDF資料
PDF描述
DS26303LN-120 3.3V, E1/T1/J1, Short-Haul, Octal Line Interface Unit
DS26303LN-75 3.3V, E1/T1/J1, Short-Haul, Octal Line Interface Unit
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DS26518G 8-Port T1/E1/J1 Transceiver
DS26518GN 8-Port T1/E1/J1 Transceiver
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