參數(shù)資料
型號： DS2151Q
英文描述： T1 Single-Chip Transceiver
中文描述： T1單芯片收發(fā)器
文件頁數(shù)： 47/51頁
文件大?。?/td> 1100K
代理商： DS2151Q
DS2151Q
47 of 51
AC CHARACTERISTICS
PARALLEL PORT
PARAMETER
ACLKI/RCLK Period
RCLK Pulse Width
(0
°
C to 70
°
C; V
DD
= 5V
±
5%)
(-40
°
C to +85
°
C for DS2151QN)
TYP
MAX
648
324
324
SYMBOL
t
CP
t
CH
t
CL
t
CH
t
CL
t
SP
t
SP
t
SH
t
SL
t
SU
MIN
UNITS
ns
ns
ns
ns
ns
ns
ns
ns
NOTES
230
230
115
115
1
RCLK Pulse Width
2
SYSCLK Period
648
488
3
4
SYSCLK Pulse Width
75
75
25
RSYNC Set Up to SYSCLK
Falling
RSYNC Pulse Width
SYSCLK Rise/Fall Times
t
SH
-5
ns
t
PW
t
R
t
F
t
DD
50
ns
ns
25
Delay RCLK or SYSCLK to
RSER Valid
Delay RCLK or SYSCLK to
RCHCLK
Delay RCLK or SYSCLK to
RCHBLK
Delay RCLK or SYSCLK to
RSYNC
Delay RCLK to RLCLK
Delay RCLK to RLINK Valid
10
80
ns
t
D1
10
90
ns
t
D2
10
90
ns
t
D3
10
80
ns
t
D4
t
D5
10
10
80
110
ns
ns
NOTES:
1.
Jitter attenuator enabled in the receive side path.
2.
Jitter attenuator disabled or enabled in the transmit path.
3.
SYSCLK=1.544 MHz
4.
SYSCLK=2.048 MHz
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