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參數(shù)資料
| 型號(hào)： | DS2151Q |
| 英文描述： | T1 Single-Chip Transceiver |
| 中文描述： | T1單芯片收發(fā)器 |
| 文件頁數(shù)： | 41/51頁 |
| 文件大小： | 1100K |
| 代理商： | DS2151Q |
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DS2151Q
41 of 51
TRANSMIT SIDE ESF TIMING
Figure 13-7
NOTES:
1.
TSYNC in the frame mode (TCR2.3=0) and double-wide frame sync is not enabled (TCR2.4=0).
2.
TSYNC in the frame mode (TCR2.3=0) and double-wide frame sync is enabled (TCR2.4=1).
3.
TSYNC in the multiframe mode (TCR2.4=1).
4.
ZBTSI mode disabled (TCR2.5=0).
5.
TLINK data (FDL bits) is sampled during the F-bit time of odd frame and inserted into the outgoing
T1 stream if enabled via TCR1.2.
6.
ZBTSI mode is enabled (TCR2.5=1).
7.
TLINK data (Z bits) is sampled during the F-bit time of frame 1, 5, 9, 13, 17, and 21 and inserted into
the outgoing stream if enabled via TCR1.2.
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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