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參數(shù)資料
| 型號(hào)： | BUS-65164-180K |
| 廠商： | DATA DEVICE CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 2 CHANNEL(S), 1M bps, MIL-STD-1553 CONTROLLER, CDFP70 |
| 封裝： | 1.900 X 1 INCH, 0.215 INCH HEIGHT, FP-70 |
| 文件頁數(shù)： | 16/40頁 |
| 文件大?。?/td> | 349K |
| 代理商： | BUS-65164-180K |
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FIGURE 9. RT TO RT (RECEIVE) TIMEOUT TIMING (CONTINUED)
ns
A6 PULSE WIDTH
INCMD RISING EDGE TO WORD COUNT VALID
t11(@12MHz)
t14
1205
75
820
ns
STATUS INPUTS HOLD TIME
ME FALLING EDGE TO INCMD RISING EDGE
t10
t13(@16MHz)
280
500
220
ns
ME FALLING EDGE TO INCMD RISING EDGE
t13(@12MHz)
360
300
ns
ms
A6 PULSE WIDTH
RT-RT NO RESPONSE TIMEOUT (MESSAGE ERROR)
t11(@16MHz)
t12
UNITS
TYP
DESCRIPTION
SYMBOL
1025
19.5
720
18.25
MAX
MIN
Notes:
1)IF ADDR_ENA IS LOGIC “1”, CS, WRT, AND A13..A0 WILL BE IN A HIGH IMPEDANCE STATE EXCEPT FOR WHEN A WORD TRANSFER IS BEING PERFORMED
(DT_ACK = LOGIC “0”).
2)THE LEADING EDGE OF TIME REFERENCE t9 AND THE TRAILING EDGE OF TIME REFERENCE t6 IS DEFINED AS THE FALLING EDGE OF DT_REQ.
3)THE TRAILING EDGE OF REFERENCE t9 IS DEFINED AS THE RISING EDGE OF DT_REQ.
4)DATA TRANSFER CYCLE TIMING INFORMATION IS DESCRIBED IN OTHER FIGURES.
DATA
STATUS
t12
WC
t13
t14
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| BU-61743F3-100W | 2 CHANNEL(S), 1M bps, MIL-STD-1553 CONTROLLER, CQFP72 |
| BU-61743F3-202L | 2 CHANNEL(S), 1M bps, MIL-STD-1553 CONTROLLER, CQFP72 |
| BU-61743F3-202W | 2 CHANNEL(S), 1M bps, MIL-STD-1553 CONTROLLER, CQFP72 |
| BU-61743F3-280L | 2 CHANNEL(S), 1M bps, MIL-STD-1553 CONTROLLER, CQFP72 |
| BU-61743F3-400Q | 2 CHANNEL(S), 1M bps, MIL-STD-1553 CONTROLLER, CQFP72 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| BU-S802 | 制造商:Fuji Electric 功能描述: |
| BU-S803 | 制造商:Fuji Electric 功能描述: |
| BUS98 | 制造商:ONSEMI 制造商全稱:ON Semiconductor 功能描述:SITCHMODE Series NPN Silicon Power Transistors |
| BUS98/D | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:SWITCHMODE? Series NPN Silicon Power Transistors |
| BUS98A | 制造商:ONSEMI 制造商全稱:ON Semiconductor 功能描述:SITCHMODE Series NPN Silicon Power Transistors |
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