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參數(shù)資料
| 型號： | AN2933 |
| 英文描述： | Understanding the eTPU Channel Hardware |
| 中文描述： | 理解硬件頻道的eTPU |
| 文件頁數(shù)： | 3/40頁 |
| 文件大?。?/td> | 741K |
| 代理商： | AN2933 |
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Architecture of the eTPU Channel
Understanding the eTPU Channel Hardware, Rev. 0
Freescale Semiconductor
3
Figure 1. eTPU Channel Logic Block Diagram
Input Signal
ipp_ind_etpuch
TCR1
TCR2
Capture A
Match A
TBSA[0]
TBSA[1]
ERA Bus
TBSA[2]
0: >=
1: ==
MRLEA
MRLA
TDLA
ucode ERWA
Set
Rst
ucode
MRLA
Rst
Set
Rst
ucode MRLE
Set
Action Logic A
Trans.A
Match A
to service request
Transition
Event
Logic
OPACA
IPACA
Capture B
Match B
TBSB[0]
TBSB[1]
ERB Bus
TBSB[2]
0: >=
1: ==
MRLEB
MRLB
TDLB
ucode ERWB
Set
Rst
ucode
MRLB
Rst
Set
Rst
ucode MRLE
Set
Action Logic B
Trans.B
MatchB
OPACB
IPACB
ECF
(Filter)
Output FF
Output
Logic
Set
Rst
OBE
FF
ucode TBSA[2:0]
PDCM
SRI
SRI
ucode
MTD
Rst
Set
ucode PDCM
ucode IPACA
ucode IPACB
ucode
OPACA
ucode
OPACB
Output Signal
ipp_do_etpuch
Output Buffer Enable
ipp_obe_etpuch
ETPUTBCR[CDCF]
to branch
PSTI
to branch
PSTO
PSC, PSCS
ucode
Channel
Flags
Flag0
Flag1
ucode FLC
Comparator
Comparator
ODIS
OPOL
Microengine
Microengine
MEF
ucode
TDL
ucode
TDL
to service request
to branch
TDLB
to branch
MRLB
to branch
TDLA
to branch
MRLA
control
Transition
Event
Logic
Match
Recognition
Match
Recognition
ETPUECR[FPSCK]
TCRCLK
Filter
Input Signal
ipp_ind_tcrclk
= Channel 0 only
AM
AM
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PDF描述 |
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