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參數(shù)資料
| 型號： | AM79C975 |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | PCnet⑩-FAST III Single-Chip 10/100 Mbps PCI Ethernet Controller with Integrated PHY |
| 中文描述： | PCnet⑩快速三單芯片10/100 Mbps的PCI以太網(wǎng)控制器集成PHY |
| 文件頁數(shù)： | 205/304頁 |
| 文件大小： | 2092K |
| 代理商： | AM79C975 |
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Am79C973/Am79C975
205
P R E L I M I N A R Y
If the Logical Address Filter is loaded with all zeros and
promiscuous mode is disabled, all incoming logical ad-
dresses except broadcast will be rejected. If the
DRCVBC bit (CSR15, bit 14) is set as well, the broad-
cast packets will be rejected. See Figure 51.
PADR
This 48-bit value represents the unique node address
assigned by the ISO 8802-3 (IEEE/ANSI 802.3) and
used for internal address comparison. PADR[0] is com-
pared with the first bit in the destination address of the
incoming frame. It must be 0 since only the destination
address of a unicast frames is compared to PADR. The
six hex-digit nomenclature used by the ISO 8802-3
(IEEE/ANSI 802.3) maps to the Am79C973/
Am79C975 PADR register as follows: the first byte is
compared with PADR[7:0], with PADR[0] being the
least significant bit of the byte. The second ISO 8802-3
(IEEE/ANSI 802.3) byte is compared with PADR[15:8],
again from the least significant bit to the most signifi-
cant bit, and so on. The sixth byte is compared with
PADR[47:40], the least significant bit being PADR[40].
Mode
The mode register field of the initialization block is cop-
ied into CSR15 and interpreted according to the de-
scription of CSR15.
Figure 51. Address Match Logic
Receive Descriptors
When SWSTYLE (BCR20, bits 7-0) is set to 0, then the
software structures are defined to be 16 bits wide, and
receive descriptors look like Table 58 (CRDA = Current
Receive Descriptor Address).
When SWSTYLE (BCR 20, bits 7-0) is set to 2, then the
software structures are defined to be 32 bits wide, and
receive descriptors look like Table 59 (CRDA = Current
Receive Descriptor Address).
When SWSTYLE (BCR 20, bits 7-0) is set to 3, then the
software structures are defined to be 32 bits wide, and
receive descriptors look like Table 60 (CRDA = Current
Receive Descriptor Address).
Table 58. Receive Descriptor (SWSTYLE = 0)
13
12
1
CRC
GEN
SEL
31
26
MUX
63
0
64
Match = 1 Packet Accepted
Match = 0 Packet Rejected
Match
Logical
Address Filter
(LADRF)
0
6
32-Bit Resultant CRC
1
0
Received Message
Destination Address
47
21510B-56
Address
CRDA+00h
CRDA+02h
CRDA+04h
CRDA+06h
15
14
11
RBADR[15:0]
CRC
10
9
8
7-0
OWN
1
0
ERR
1
0
FRAM
1
0
OFLO
1
0
BUFF
STP
ENP
RBADR[23:16]
BCNT
MCNT
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PDF描述 |
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