參數(shù)資料
型號： AFE2124
英文描述： Dual HDSL/SDSL ANALOG FRONT END
中文描述： 雙HDSL / SDSL是模擬前端
文件頁數(shù)： 4/11頁
文件大小： 187K
代理商： AFE2124
4
AFE2124
PIN CONFIGURATION
Top View
SSOP
PIN DESCRIPTIONS
PIN #
CHANNEL A
1
TYPE
NAME
DESCRIPTION
Output
Data OutA
Output Data Word
2
Input
rx48xCLKA
Receive Clock at 48x Baud Clock
(23.032MHz for E1)
3
Input
rxbaudCLKA
Receive Baud Clock (584kHz for E1)
4
Input
Data InA
Input Data Word
5
Input
tx48xCLKA
Transmit Clock (584kHz for E1)
6
Input
txbaudCLKA
Transmit Baud Clock at 48x Baud Clock
(584kHz for E1)
7
Power
DV
DD
DGND
Digital Supply (+3.3V to +5V)
8
Ground
Digital Ground
9
Ground
AGND
Analog Ground
10
Output
txLINE+A
Transmit Line Driver Output, Positive
11
Power
AV
DD
txLINE–A
Analog Supply (+5V)
12
Output
Transmit Line Driver Output, Negative
13
Ground
AGND
Analog Ground
14
Power
AV
DD
REF
N
A
V
CM
A
REF
P
A
AGND
Analog Supply (+5V)
15
Output
Negative Reference Output
16
Output
Common-Mode Voltage (buffered)
17
Output
Positive Reference Output
18
Ground
Analog Ground
19
Ground
AGND
Analog Ground
20
Input
rxLINE+A
Positive Line Input
21
Input
rxLINE–A
Negative Line Input
22
Input
rxHYB+A
Positive Input from Hybrid Network
23
Input
rxHYB–A
Negative Input from Hybrid Network
24
Power
AV
DD
AV
DD
Analog Supply (+5V)
25
Power
Analog Supply (+5V)
CHANNEL B
26
Input
rxHYB–B
Negative Input from Hybrid Network
27
Input
rxHYB+B
Positive Input from Hybrid Network
28
Input
rxLINE–B
Negative Line Input
29
Input
rxLINE+B
Postiive Line Input
30
Ground
AGND
Analog Ground
31
Ground
AGND
Analog Ground
32
Output
REF
P
B
V
CM
B
REF
N
B
AV
DD
AGND
Positive Reference Output
33
Output
Common-Mode Voltage (buffered)
34
Output
Negative Reference Output
35
Power
Analog Supply (+5V)
36
Ground
Analog Ground
37
Output
txLINE–B
Transmit LIne Driver Output, Negative
38
Power
AV
DD
txLINE+B
Analog Supply (+5V)
39
Output
Transmit Line Driver Output, Positive
40
Ground
AGND
Analog Ground
41
Ground
DGND
Digital Ground
42
Power
DV
DD
Digital Supply (+3.3V to +5V)
43
Input
txbaudCLKB
Transmit Baud Clock (584kHz for E1)
44
Input
tx48xCLKB
Transmit Clock at 48x Baud Clock
(28.032MHz for E1)
45
Input
Data InB
Input Data Word
46
Input
rxbaudCLKB
Receive Baud Clock (584kHz for E1)
47
Input
rx48xCLKB
Receive Clock at 48x Baud Clock
(28.032MHz for E1)
48
Output
Data OutB
Output Data Word
Data OutA
rx48xCLKA
rxbaudCLKA
Data InA
tx48xCLKA
txbaudCLKA
DV
DD
DGND
AGND
txLINE+A
AV
DD
txLINE–A
AGND
AV
DD
REF
N
A
V
CM
A
REF
P
A
AGND
AGND
rxLINE+A
rxLINE–A
rxHYB+A
rxHYB–A
AV
DD
Data OutB
rx48xCLKB
rxbaudCLKB
Data InB
tx48xCLKB
txbaudCLKB
DV
DD
DGND
AGND
txLINE+B
AV
DD
txLINE–B
AGND
AV
DD
REF
N
B
V
CM
B
REF
P
B
AGND
AGND
rxLINE+B
rxLINE–B
rxHYB+B
rxHYB–B
AV
DD
1
2
3
4
5
6
7
8
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48
47
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39
38
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25
AFE2124
Channel A
Channel B
相關(guān)PDF資料
PDF描述
AFE2124E Dual HDSL/SDSL ANALOG FRONT END
AFE8201 IF Analog-to-Digital Converter with Digital Downconverter
AFE8201PFBR IF Analog-to-Digital Converter with Digital Downconverter
AFE8201PFBT IF Analog-to-Digital Converter with Digital Downconverter
AG-TL500 CTV 6C 6#20 PIN WALL RECP
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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AFE2124E/1K 功能描述:電信線路管理 IC Dual HDSL/SDSL Analog Front End RoHS:否 制造商:STMicroelectronics 產(chǎn)品:PHY 接口類型:UART 電源電壓-最大:18 V 電源電壓-最小:8 V 電源電流:30 mA 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:VFQFPN-48 封裝:Tray
AFE2124E/1KG4 功能描述:電信線路管理 IC Dual HDSL/SDSL Analog Front End RoHS:否 制造商:STMicroelectronics 產(chǎn)品:PHY 接口類型:UART 電源電壓-最大:18 V 電源電壓-最小:8 V 電源電流:30 mA 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:VFQFPN-48 封裝:Tray
AFE2124EG4 功能描述:電信線路管理 IC Dual HDSL/SDSL Analog Front End RoHS:否 制造商:STMicroelectronics 產(chǎn)品:PHY 接口類型:UART 電源電壓-最大:18 V 電源電壓-最小:8 V 電源電流:30 mA 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:VFQFPN-48 封裝:Tray
AFE2126 制造商:BB 制造商全稱:BB 功能描述:Dual HDSL/SDSL ANALOG FRONT END
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