參數(shù)資料
型號： AFE1230E
英文描述： G.SHDSL ANALOG FRONT-END
中文描述： 灣SHDSL的模擬前端
文件頁數(shù)： 7/15頁
文件大?。?/td> 313K
代理商： AFE1230E
AFE1230
SBWS015A
7
FIGURE 5. AFE1230/DSP Digital Interface.
FIGURE 6. AFE1230 Transmit Timing Diagram.
FIGURE 7. AFE1230 Receive Timing Diagram.
G.SHDSL
DSP
AFE1230
txBaud, Transmit Baud Clock
txData, Transmit Data
MCLK, Master Clock (48x)
rxBaud, Receive Baud Clock
rxData, Receive Data
txData
MCLK
txBaud
0
1
0
47
1
Bit 0
Bit 47
Bit 0
Bit 47
2.5ns
2.5ns
5ns
t
W
t
F
t
F
rxData
MCLK
rxBaud
0
1
0
47
1
Bit 0
Bit 47
Bit 0
Bit 47
1ns
6ns
5ns
t
F
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