參數(shù)資料
型號： ADAU1781BCPZ
廠商： Analog Devices Inc
文件頁數(shù)： 70/92頁
文件大?。?/td> 0K
描述： IC SIGMADSP CODEC LN 32LFCSP
標準包裝： 1
系列： SigmaDSP®
類型： 立體聲音頻
數(shù)據接口： I²C，串行，SPI?
分辨率（位）： 24 b
ADC / DAC 數(shù)量： 2 / 2
三角積分調變： 無
S/N 比，標準 ADC / DAC (db)： 100 / 105（差分），100 / 103（單端）
動態(tài)范圍，標準 ADC / DAC (db)： 99.2 / 105（差分），99.2 / 103（單端）
電壓 - 電源，模擬： 1.8 V ~ 3.65 V
電壓 - 電源，數(shù)字： 1.63 V ~ 3.65 V
工作溫度： -25°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 32-VFQFN 裸露焊盤，CSP
供應商設備封裝： 32-LFCSP-VQ
包裝： 托盤
ADAU1781
Rev. B | Page 72 of 92
Register 16425 (0x4029), Playback Power Management
This register controls the unity current supplied to each functional
block described. Within the functional blocks, the current can
be multiplied. Normal operation has a base current of 2.5 μA,
enhanced performance has a base current of 3 μA, power saving
has a base current of 2 μA, and extreme power saving has a base
current of 1.5 μA. Enhanced performance mode offers the best
audio quality but also uses the most current.
Bit [7:6], Speaker Amplifier Bias Control
These bits control the amount of unity bias current allotted to
the speaker amplifier.
Bits[5:4], DAC Bias Control
These bits control the amount of unity bias current allotted to
the DAC.
Bits[3:2], Back-End Bias Control
These bits control the amount of unity bias current allotted to
the playback mixers and amplifiers.
Bit 1, Back-End Right Enable
This bit enables the playback mixers and amplifiers.
Bit 0, Back-End Left Enable
This bit enables the playback mixers and amplifiers.
Table 61. Playback Power Management Register
Bits
Description
Default
[7:6]
Speaker amplifier bias control
00
00: normal operation
01: power saving
10: enhanced performance
00: reserved
[5:4]
DAC bias control
00
00: normal operation
01: extreme power saving
10: power saving
00: enhanced performance
[3:2]
Back-end bias control
00
00: normal operation
01: extreme power saving
10: power saving
00: enhanced performance
1
Back-end right enable
0
0: disabled
1: enabled
0
Back-end left enable
0
0: disabled
1: enabled
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PDF描述
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