參數(shù)資料
型號(hào)： ADAU1781BCPZ
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 64/92頁(yè)
文件大小： 0K
描述： IC SIGMADSP CODEC LN 32LFCSP
標(biāo)準(zhǔn)包裝： 1
系列： SigmaDSP®
類型： 立體聲音頻
數(shù)據(jù)接口： I²C，串行，SPI?
分辨率（位）： 24 b
ADC / DAC 數(shù)量： 2 / 2
三角積分調(diào)變： 無(wú)
S/N 比，標(biāo)準(zhǔn) ADC / DAC (db)： 100 / 105（差分），100 / 103（單端）
動(dòng)態(tài)范圍，標(biāo)準(zhǔn) ADC / DAC (db)： 99.2 / 105（差分），99.2 / 103（單端）
電壓 - 電源，模擬： 1.8 V ~ 3.65 V
電壓 - 電源，數(shù)字： 1.63 V ~ 3.65 V
工作溫度： -25°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 32-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 32-LFCSP-VQ
包裝： 托盤
ADAU1781
Rev. B| Page 67 of 92
Register 16410 (0x401A), Left ADC Attenuator
Bits[7:0], Left ADC Digital Attenuator
These bits control a 256-step, logarithmically spaced volume
control from 0 dB to 95.625 dB, in increments of 0.375 dB.
When a new value is entered into this register, the volume control
slews gradually to the new value, avoiding pops and clicks in the
process. The slew ramp is logarithmic, incrementing 0.375 dB
per audio frame.
Register 16411 (0x401B), Right ADC Attenuator
Bits[7:0], Right ADC Digital Attenuator
These bits control a 256-step, logarithmically spaced volume
control from 0 dB to 95.625 dB, in increments of 0.375 dB.
When a new value is entered into this register, the volume control
slews gradually to the new value, avoiding pops and clicks in the
process. The slew ramp is logarithmic, incrementing 0.375 dB
per audio frame.
Table 51. Left ADC Attenuator Register
Bits
Description
Default
[7:0]
Left ADC digital attenuator; attenuation is in increments of 0.375 dB with each step of slewing
00000000
00000000: 0 dB
00000001: 0.375 dB
00000010: 0.75 dB
…
11111110: 95.25 dB
11111111: 95.625 dB
Table 52. Right ADC Attenuator Register
Bits
Description
Default
[7:0]
Right ADC digital attenuator; attenuation is in increments of 0.375 dB with each step of slewing
00000000
00000000: 0 dB
00000001: 0.375 dB
00000010: 0.75 dB
…
11111110: 95.25 dB
11111111: 95.625 dB
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PDF描述
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