參數(shù)資料
型號： ADAU1761BCPZ
廠商： Analog Devices Inc
文件頁數(shù)： 50/92頁
文件大?。?/td> 0K
描述： IC SIGMADSP CODEC PLL 32LFCSP
設(shè)計資源： Stereo Digital Microphone Input Using ADAU1761 and ADMP421 (CN0078)
標準包裝： 1
系列： SigmaDSP®
類型： 音頻編解碼器
數(shù)據(jù)接口： 串行
分辨率（位）： 24 b
ADC / DAC 數(shù)量： 2 / 2
三角積分調(diào)變： 是
電壓 - 電源，模擬： 1.8 V ~ 3.65 V
電壓 - 電源，數(shù)字： 1.63V ~ 3.65V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 32-VFQFN 裸露焊盤，CSP
供應商設(shè)備封裝： 32-LFCSP-VQ
包裝： 托盤
產(chǎn)品目錄頁面： 776 (CN2011-ZH PDF)
配用： EVAL-ADAU1761Z-ND - BOARD EVAL FOR ADAU1761
ADAU1761
Rev. C | Page 54 of 92
R2: Digital Microphone/Jack Detection Control, 16,392 (0x4008)
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
JDDB[1:0]
JDFUNC[1:0]
Reserved
JDPOL
Table 36. Digital Microphone/Jack Detection Control Register
Bits
Bit Name
Description
[7:6]
JDDB[1:0]
Jack detect debounce time.
Setting
Debounce Time
00
5 ms (default)
01
10 ms
10
20 ms
11
[5:4]
JDFUNC[1:0]
JACKDET/MICIN pin function. Enables or disables the jack detect function or configures the pin for a digital
microphone input.
40 ms
Setting
Pin Function
00
Jack detect off (default)
01
Jack detect on
10
Digital microphone input
11
0
JDPOL
Jack detect polarity. Detects high or low signal.
0 = detect high signal (default).
1 = detect low signal.
Reserved
R3: Record Power Management, 16,393 (0x4009)
This register manages the power consumption for the record path. In particular, the current distribution for the mixer boosts, ADCs,
record path mixers, and PGAs can be set to one of four modes. These settings are normal operation, power saving mode, enhanced
performance mode, and extreme power saving mode. Each of these modes draws current from a central bias. Enhanced performance
mode offers the highest performance with the trade-off of higher power consumption.
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Reserved
MXBIAS[1:0]
ADCBIAS[1:0]
RBIAS[1:0]
Reserved
Table 37. Record Power Management Register
Bits
Bit Name
Description
[6:5]
MXBIAS[1:0]
Mixer amplifier bias boost. Sets the boost level for the bias current of the record path mixers. In some cases,
the boost level enhances the THD + N performance.
Setting
Boost Level
00
Normal operation (default)
01
Boost Level 1
10
Boost Level 2
11
Boost Level 3
[4:3]
ADCBIAS[1:0]
ADC bias control. Sets the bias current for the ADCs based on the mode of operation selected.
Setting
ADC Bias Control
00
Normal operation (default)
01
Extreme power saving
10
Enhanced performance
11
Power saving
[2:1]
RBIAS[1:0]
Record path bias control. Sets the bias current for the PGAs and mixers in the record path.
Setting
Record Path Bias Control
00
Normal operation (default)
01
Reserved
10
Enhanced performance
11
Power saving
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PDF描述
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參數(shù)描述
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ADAU1772BCPZ 功能描述:接口—CODEC Low Latency Noise and Power CODEC RoHS:否 制造商:Texas Instruments 類型: 分辨率: 轉(zhuǎn)換速率:48 kSPs 接口類型:I2C ADC 數(shù)量:2 DAC 數(shù)量:4 工作電源電壓:1.8 V, 2.1 V, 2.3 V to 5.5 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:DSBGA-81 封裝:Reel
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