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參數(shù)資料
| 型號： | AD5379ABCZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 2/29頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DAC 14BIT 40CHAN 108CSPBGA |
| 產(chǎn)品培訓(xùn)模塊： | Data Converter Fundamentals DAC Architectures |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 設(shè)置時間： | 20µs |
| 位數(shù)： | 14 |
| 數(shù)據(jù)接口： | 串行，并聯(lián) |
| 轉(zhuǎn)換器數(shù)目： | 40 |
| 電壓電源： | 模擬和數(shù)字，雙 ± |
| 功率耗散（最大）： | 850mW |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 108-BGA，CSPBGA |
| 供應(yīng)商設(shè)備封裝： | 108-CSPBGA（13x13） |
| 包裝： | 托盤 |
| 輸出數(shù)目和類型： | 40 電壓，雙極 |
| 采樣率（每秒）： | 50k |
| 配用： | EVAL-AD5379EBZ-ND - BOARD EVALUATION FOR AD5379 |
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AD5379
Rev. B | Page 9 of 28
PARALLEL INTERFACE
VCC = 2.7 V to 5.5 V; VDD = 11.4 V to 16.5 V; VSS = 11.4 V to 16.5 V; AGND = DGND = DUTGND = 0 V; VREF(+) = 5 V;
VREF() = 3.5 V, FIFOEN = 0 V; all specifications TMIN to TMAX, unless otherwise noted.
Table 5.
Limit at TMIN to TMAX
Unit
Description
t0
4.5
ns min
REG0, REG1, address to WR rising edge setup time.
t1
4.5
ns min
REG0, REG1, address to WR rising edge hold time.
t2
10
ns min
CS pulse width low.
t3
10
ns min
WR pulse width low.
t4
0
ns min
CS to WR falling edge setup time.
t5
0
ns min
WR to CS rising edge hold time.
t6
4.5
ns min
Data to WR rising edge setup time.
t7
4.5
ns min
Data to WR rising edge hold time.
t8
20
ns min
WR pulse width high.
t9
240
ns min
Minimum WR cycle time (single-channel write).
0/30
ns min/max
WR rising edge to BUSY falling edge.
t114
330
ns max
BUSY pulse width low (single-channel update). See
.
t12
0
ns min
BUSY rising edge to WR rising edge.
t13
30
ns min
WR rising edge to LDAC falling edge.
t14
20
ns min
LDAC pulse width low.
t154
150
ns typ
BUSY rising edge to DAC output response time.
t16
20
ns min
LDAC rising edge to WR rising edge.
t17
0
ns min
BUSY rising edge to LDAC falling edge.
t18
100
ns typ
LDAC falling edge to DAC output response time.
t19
20/30
μs typ/ max
DAC output settling time.
t20
10
ns min
CLR pulse width low.
t21
350
ns max
CLR/RESET pulse activation time.
t22
10
ns min
RESET pulse width low.
t23
120
μs max
RESET time indicated by BUSY low.
1 Guaranteed by design and characterization, not production tested.
2 All input signals are specified with tr = tf = 2 ns (10% to 90% of VCC), and timed from a voltage level of 1.2 V.
3 See Figure 6.
4 Measured with load circuit shown in Figure 2.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AD664JN-UNI | IC DAC 12BIT QUAD UNIPOL 28-DIP |
| AD664JN-BIP | IC DAC 12BIT QUAD BIPOLAR 28-DIP |
| AD5371BBCZ | IC DAC 14BIT 40CH SER 100-CSPBGA |
| ADDAC80-CCD-V | IC DAC 12BIT LOW COST 24-CDIP |
| AD5532ABC-3 | IC DAC 14BIT 32CH 74-CSPBGA |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AD537JCHIPS | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Voltage-to-Frequency Converter |
| AD537JD | 功能描述:IC V/F CONV 14-CDIP RoHS:否 類別:集成電路 (IC) >> PMIC - V/F 和 F/V 轉(zhuǎn)換器 系列:- 標(biāo)準(zhǔn)包裝:1 系列:- 類型:頻率至電壓 頻率 - 最大:10kHz 全量程:- 線性:±0.3% 安裝類型:表面貼裝 封裝/外殼:8-SOIC（0.154"，3.90mm 寬） 供應(yīng)商設(shè)備封裝:8-SOIC 包裝:Digi-Reel® 其它名稱:LM2917MX-8/NOPBDKR |
| AD537JH | 功能描述:IC V/F CONV TO-100-10 RoHS:否 類別:集成電路 (IC) >> PMIC - V/F 和 F/V 轉(zhuǎn)換器 系列:- 標(biāo)準(zhǔn)包裝:1 系列:- 類型:頻率至電壓 頻率 - 最大:10kHz 全量程:- 線性:±0.3% 安裝類型:表面貼裝 封裝/外殼:8-SOIC（0.154"，3.90mm 寬） 供應(yīng)商設(shè)備封裝:8-SOIC 包裝:Digi-Reel® 其它名稱:LM2917MX-8/NOPBDKR |
| AD537JH | 制造商:Analog Devices 功能描述:SEMICONDUCTORS LINEAR 制造商:Analog Devices 功能描述:V/F CONVERTER 150KHZ 0.15% |
| AD537JH | 制造商:Analog Devices 功能描述:IC, V/F CONVERTER, 150KHZ, 0.15%, TO-100 |
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